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[参考译文] DP83869HM:RGMII 桥接至 SGMII、MAC 桥接至 MAC 配置

Guru**** 2452720 points
Other Parts Discussed in Thread: DP83869HM

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/911770/dp83869hm-bridge-rgmii-to-sgmii-mac-to-mac-configuration

器件型号:DP83869HM
主题中讨论的其他器件: DP83869

您好!


我尝试使用 DP83869HM 作为 RGMII 到 SGMII 的桥接器(从 ASIC (MAC)到微处理器(MAC))。
我在配置方面遇到了一些问题。  首先、我无法通过自协商使能获得链路状态。
我检查了寄存器 OP_MODE_CODE (0x1DF)并尝试了值0x43和0x03 (RGMII 至 SGMII 或 SGMII 至 RGMII)
我设置差分寄存器、以便在 CLK_OUT 上获得125MHz:reg (0x170)= 0x800和 REG (0xC6)= 0x10。 我在125MHz 时获得了正确的 CLK_OUT。 但我无法在 RX_CLK 上获得125MHz、因为(我想)链路状态已关闭。

因此、我希望在配置方面获得一些帮助、谢谢。

BR、

Julien

DP83869HM

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    您好、Julien、

    您要选择在桥接模式下的工作速度、哪种 MAC 接口? 在 RGMII 至 SGMII 中、SGMII MAC 将选择运行速度并相应地调整 RGMII。  

     配置寄存器0x1DF 后、您能否确认是否已写入寄存器0x0C00=0x1140?

    您如何确定链路状态?  

    另请注意、通过寄存器配置将器件设置为桥接模式时、数据表中存在错误:  

    OP_MODE_DED 寄存器0x1DF 的位6中的描述错误。 应按如下所示翻转它:

    0x1 = RGMII 至 SGMII 桥接器
    0x0 = SGMII 至 RGMII 桥接器

    此致、
    Justin  

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    您好 Justin、

    感谢您的回答。

    是的、我假设 MAC SGMII 以千兆位为单位运行速度、因此我写入 REG (0x1DF)=0x43。 (但是、我尝试了两种配置 REG (0x1DF)=0x03、因为我在论坛中发现了寄存器0x1DF 的错误...)

    是的、配置寄存器0x1DF 后、我确认写入 REG (0xC00)=0x1140。

    我使用寄存器 BMSR 位2获取"链路状态"、使用"AutoNeg comp"的位5、两者均为0。

    我在文档中找到:"如果 PHY 没有链路、RGMII 时钟频率将默认为2.5MHz。"、因此我无法在 RX_CLK 上获得125MHz。

    非常感谢您的帮助、

    BR、

    Julien

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    您好、Julien、

    在 RGMII 至 SGMII 桥接模式下、DP83869需要将 PHY 连接到 SGMII 接口。 这意味着 SGMII 可能无法与连接到 SGMII 接口的 MAC 自动协商。  

    您可以通过寄存器0x14[位9]=0将 DP83869设置为禁用 SGMII 自动协商。  

    此致、

    Justin  

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    您好 Justin、

    感谢您的回答。

    好的、不幸的是、这是我假定的。 是的、我在没有良好结果的情况下尝试了0x14寄存器。 我仍然卡在2.5MHz RX_CLK 上。

    谢谢、

    BR、

    Julien

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    (校正寄存器(0x14)的位7:SGMII_AutoNeg_EN)

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    您好、Julien、

    您还可以尝试扩展寄存器0x0031[6:5]=11中的 SGMII 自动协商计时器。 在自协商重新开始之前、某些 MAC 在2us 中的反应速度不能足够快。  

    在更改这些寄存器后、您应该提供0x001F=0x4000的软复位、以使用更新的寄存器配置复位 PHY。

    是否可以连接使用 SGMII 转 RGMII 桥接模式并连接 RGMII 接口以获取链路和速度信息?  

    此致、

    Justin  

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    您好 Justin、

    感谢您的回答。

    我今天早上已经尝试了 REG (0x31)=0x60、并进行了软件复位、结果不是很好。

    不幸的是、我无法使用 RGMII 来获取链接、因为(我想)我无法在 RX_CLK 上获取正确的时钟。

    再次感谢、

    BR、

    Julien

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    您好 Justin、

    我仍在尝试解决此问题、但无法在 SGMII (和 RGMII)上进行自动协商。 MAC SGMII 无法进行协商,因为组件 P1010中的勘误表...

    您是否认为可以定义千兆位级的 RGMII 链路? 并通过配置 PHY 寄存器将 RX_CLK 设置为125MHz 吗? (无链路状态)

    或强制开启链路状态?

    谢谢您、

    BR、

    Julien

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    您好、Julien、

    在 SGMII 至 RGMII 桥接模式下、DP83869充当连接的 RGMII PHY 的 RGMII MAC (在本例中为另一个 MAC)。 RGMII PHY 需要将125MHz 时钟发送到 DP83869以创建链路。  

    此致、
    Justin  

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    您好 Justin、

    以下是连接到 DP83869的时钟信号:

    -      在125MHz 下、将 TX_CLK 从 RGMII MAC 更改为 DP83869 (正常)

    -      CLK_OUT 从 DP83869以125MHz 的频率连接到 RGMII 和 SGMII MAC (如果寄存器0xC6写入0x10、则正常)

    -      在 125MHz è KO 下、从 DP83869到 RGMII MAX 的 RX_CLK 卡在2.5MHz

    在进一步尝试交换帧之前、我尝试使时钟以正确的频率工作。

    由于我的 MAC 都无法执行自动连接、因此我尝试通过 MDIO 写入其寄存器、将网桥设置为在千兆位模式下工作。 在我看来,只要 AutoNeg 没有完成(无法完成),RX_CLK 就不能按这种方式设置并保持其默认值。

    以下是我的问题:

    -      是否可以将 DP83869设置为用作桥接 RGMII/SGMII 1Gbps 而无需任何自动协商过程?

    -      配置是什么(捆绑/寄存器)?

    BR、

    Julien

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    您好!

    最后、我成功地将该组件用作 RGMII 至 SGMII 桥接器、而无需任何自动协商过程。

    配置如下:

    REG (0x170)= 0x8 << 8 #在125MHz 时激活 CLK_OUT

    寄存器(0xC6)= 0x10 # CLK-OUT 控制寄存器(PLLCTL)

    寄存器(0xC00)= 0x0140 #位12 ="0"=自动重置不可

    在我们的案例中、在 Mac RGMII 和 SGMII 之前激活电桥非常重要。

    谢谢您、

    BR、

    Julien