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[参考译文] DP83822I:DP83822I 引导硬件配置时序

Guru**** 2928900 points

Other Parts Discussed in Thread: DP83822I

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/920374/dp83822i-dp83822i-bootstrap-hardware-configuration-timing

器件型号:DP83822I

大家好、

我是否可以询问 DP83822I 在复位后读取自举引脚状态的持续时间? 在数据表图2中、它似乎是 T3锁存时间。

但是、当我们的客户尝试测试此时序时、他们发现在复位上升至中点之前、自举引脚将由 DP83822I 自身保持(指示硬件锁存已结束)。 请参阅以下波形。(CH1 (黄色):RESET、CH2 (蓝色):RX_D0、CH3 (紫色):CRS)。

我们有一个用于复位的上升时间、这主要是因为复位引脚上的电容器。

如果移除 C453、我们将在复位时看到更高的 dv/dt、但在复位上升至中点之前、自举引脚仍将保持低电平。

我们能否确认 T3是 DP83822I 在复位后读取自举引脚状态的持续时间? 如果是、我们应该从哪个起点(从哪个复位引脚电压电平/阈值)?  为什么自举引脚在复位上升至中点之前保持低电平、这与图2不同?

谢谢。

此致、

利维亚

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    Livia、您好!

    复位电平的准确检测点取决于该部件中引脚的输入阈值。 我们保证、自举将在 T3时间内被锁存、复位时间将超过 VIH 电平规格。

    --

    此致、

    Vikram

     

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    您好、Vikram、

    在客户设计中、VDDIO = 3.3V、因此 VIH 应根据数据表为1.7V。

    但是、为什么在复位电压超过1.7V 之前、自举引脚被保持在低电平(这应该表明自举被锁存)?

    此致、

    利维亚

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    您好、Vikram、

    我是否可以对此案例进行更新?

    谢谢。

    此致、

    利维亚

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    Livia、您好!

    如前所述、跳闸点或引脚阈值可能与 VIH 和 VIL 不同。 VIH 是我们保证其被检测到为高电平的点、但实际跳变点也可能低于 VIH。 在本例中、它看起来大约为1V。

    --

    此致、

    Vikram