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[参考译文] DP83867IS：RGMII 内部延迟补偿所需的 PCB 布线长度

admin
Guru**** 2914580 points

Other Parts Discussed in Thread: DP83867IS

请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/698985/dp83867is-requited-pcb-trace-length-for-rgmii-internal-delay-compensation

器件型号：DP83867IS

大家好、

我在 DP83867IS 数据表中找到了以下注释。 不过、我认为需要大约2.25m 的额外迹线来为 FR-4 PCB 引入1.5ns 延迟...

TI 最终建议使用偏斜控制寄存器或迹线补偿的内部延迟补偿采用哪种方式？

在没有 RGMII 内部延迟的情况下运行时、PCB 设计需要对时钟进行布线、以便在相关的时钟信号中添加大于1.5ns 的额外布线延迟。


此致、

Takashi Onawa

  • 0
    TI__Guru**** 2914580 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    你好、Takashi-San、

    由于迹线寄生、迹线补偿是不可能的。
    必须在 PHY 或 MAC 内使用内部延迟。
    DP83867IS 有一个寄存器、用于控制 TX 和 RX 路径上的内部延迟。
  • 0
    TI__Guru**** 2914580 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    您好、Ross - San、

    感谢您对此问题的快速响应。
    好的、我明白了。

    顺便说一下、我在计算布线长度估算时出错了... 1.5ns 所需的布线长度应约为0.225m。

    此致、
    Takashi Onawa