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[参考译文] TLK1501EVM:TLK1501EVM

Guru**** 1095350 points
Other Parts Discussed in Thread: TLK1501, TLK1501EVM
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/933952/tlk1501evm-tlk1501evm

器件型号:TLK1501EVM
Thread 中讨论的其他器件:TLK1501

技术支持部门、您好!

尝试设置 TLK1501EVM 演示板时、我复制了《TLK1501 SERDES EVM 套件设置和使用用户指南》中的测试场景。  我使用的示例位于图2-2中的第2-4页。 "PRBS_PASS" I/O 引脚从不置为有效。  我使用2.5VDC 为 EVAL 板供电、并在"GTX_CLK"的输入端应用直流偏置 CMOS 时钟。  将示波器连接到其中一个差分对输出(TXP)后、当我将 EVM 设置为生成假随机位模式时、我看不到任何活动。 我连接了 EVM、其中 TX+和 Tx-连接到相应的 RX 和 RX+ SMA 端口。 我还按照示例中所示的跳线选择进行了操作。 我认为时钟可能存在问题、因此我很幸运地尝试应用 LVPECL 和 CML 等各种时钟方案。 CMOS 时钟似乎最适合 TLK1051数据表中所述的逻辑电平。

寻找一些建议或方向、了解我可以尝试的其他方面。

感谢你能抽出时间、

Mike  

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    已注意到请求。 我将在明天(星期二)的工作结束前提供我的意见。

    因此、

    Rodrigo Natal

    HSSC 应用工程师

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    您好!

    您能否确认以下内容:

    • J5使用正确的跳线放置?
      • 根据用户指南:附录 A 中图8和10的 TX 和 RX 并行连接器 J1–J4提供了发送和接收数据的连接。 参考时钟通过 SMA 连接器 J8供电、跳线 J5必须安装在引脚1和2之间
    • PRBSEN 在您的电路板上被拉高?
      • 在 EVM 板上、R11上必须具有4.7k Ω 的电阻、然后将 PRBSEN 拉至 VDD

    因此、

    Rodrigo Natal

    HSSC 应用工程师

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    罗德里戈、您好!

    是的、先生、我已检查以确保 J5上的引脚1和2已跳接在一起。 我将为 SMA 连接器上的 J8提供 CMOS 级时钟。 我还确保 移除了 J7上的 PRBSEN 跳线、以便 R11将 PRBSEN 拉至高电平。

    您在用户指南的附录 A 中提到了图8和10。 我想知道我是否正在使用不同版本的用户指南。 附录 A 仅包含原理图和电路板布局图像。 我正在根据从"https://www.ti.com/tool/TLK1501EVM?keyMatch=TLK1501EVM&tisearch=e2eSearch-EN-support#supportandcommunity"下载的用户指南进行工作 、日期为2000年6月14日。 我正在尝试使第2-4页的图2-2正常工作。  

     连接器 J13上有一根4英寸同轴电缆短接至 SMA 连接器 J17、J14上有一根 SMA 同轴电缆连接至 SMA 连接器 J23。

    我已将示波器连接到 J14以检查是否有任何活动。 在示波器上未观察到波形输出。 我有一个连接到 J3和 J4的逻辑分析仪来监控输出。   

    请告知、

    Mike

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    我使用的用户指南版本也是2000年6月。 在附录中、您应该能够看到"图 A–8.Top Layer 1"。 该层包含连接器、其器件型号可从丝印中读取。 您能否提供有关 GTX_CLK 输入信号的更多详细信息?

    • 频率
    • 振幅、Vhigh、Vlow、直流偏置电平(如果适用)
    • 典型抖动

    此致、

    Rodrigo Natal

    HSSC 应用工程师

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    罗德里戈、您好!

    时钟的工作频率当前设置为50MHz。 我试过30Mhz 和70MHz、但运气不好。

    GTX_CLK 输入时钟特性如下:

    振幅:3.48v

    VHigh:3.36伏

    低电压:-120mV

    直流偏置:1.52v

    抖动:< 80ps -我的旧版 O 示波器没有可精确测量的分辨率。

    我认为输入时钟符合 TLK1501数据表中定义的规格。

    请告知、

    Mike

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    您好!

    我正在对可能发生的情况进行刮擦。 其他一些建议:

    • 如果您交流耦合 GTX_CLK 的时钟信号、是否会产生影响?
    • 您能否测量电路板上的 TESTEN PRBSEN 和使能值?

    因此、

    Rodrigo Natal

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    罗德里戈、您好!

    我考虑了交流耦合、但我犹豫不决、因为我不想通过降低到数据表中指定的-0.3V 额定值来损坏 GTX_CLK 输入。 如果我尝试交流耦合时钟、您是否会看到任何问题?

    使用电压表、TESTEN 和 PRBSEN 测量0伏。 这两个引脚上有跳线、可将它们连接到接地端。  

    使能引脚会测量~2.5伏、因为它是开路的。

    我在 R22的焊盘上放置一个示波器探针、以查看 TLK1501的 GTX-CLK 输入端的时钟看起来是什么样的。  未组装 R21、但我通过连接到 R21和 R23的同一个焊盘进行监控。

    时钟峰峰值电平在该位置显著下降。 电压电平降至 CMOS 时钟规格以下。 通过查看 用作时钟电路下拉/负载电阻器的 R23的电阻值、可以看到有一个50欧姆的电阻器。 如果我从电路中移除 R23以移除负载、您是否会看到任何问题?

    请告知、

    Mike  

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    相关:"如果我从电路中移除 R23、以便移除负载、您是否会看到任何问题"

    • 我认为值得尝试、因为您看到时钟峰峰值电平的电压大幅下降

    我建议等待使用交流耦合 GTX_CLK 信号执行任何测试、直到您先执行上述测试检查。

    因此、

    Rodrigo Natal

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    罗德里戈、您好!

    我移除了 R23 50欧姆电阻器。 不幸的是、我们不能幸运地解决问题。 使用示波器检查 GTX_CLK 输入端的时钟电平、它们看起来是正确的。 但是、SEDES 不工作。

    我确实有一些好消息。 由于 SERDES 对我们的项目至关重要、因此我们购买了第二块开发板。 连接到我们的时钟和逻辑分析仪后、第二个 SERDES 板工作正常。 我们不必更改任何内容、电路板开箱即用。  因此,我的怀疑已经得到证实,我们一直在与坏板对抗。 最后,我们可以向前迈进,并努力赶上进度,因为这些问题使我们倒退了几个星期。

    感谢您的所有支持和指导。

    我还有一个问题、那么我将不再对您造成麻烦。 您能否将我转至能够帮助更换无法正常工作的 SERDES 板的人员?

    请注意、

    Mike  

     

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    请查看下面的链接以了解流程详细信息。

    www.ti.com/.../customer-returns.html

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    感谢所有的帮助!

    Mike