[参考译文] TMDS181：TMDS181没有发送到 FPGA 的输出信号

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https://e2e.ti.com/support/interface-group/interface/f/interface-forum/934066/tmds181-tmds181-don-t-have-output-signals-to-fpga

器件型号：TMDS181

您好、TI 专家、

我在项目中使用了 TMDS181。我在调试中遇到了一个关键问题。您可以参阅附件中的我的方框设计图和原理图。我可以在 TMDS181输入侧捕获从 PC 发送的148.5Mhz 时钟信号、但无法在 FPGA 侧捕获 TMDS181的时钟信号输出。我在设计中使用了引脚搭接模式。

我的配置如下：

1) SIG_EN (引脚17) 、具有 64.9k 电阻器下拉电阻器

2) I2C_EN_PIN (引脚10)、具有 64.9k 电阻器下拉电阻器

3) OE (引脚42) 、4.7K 电阻上拉至3.3V

4) EQ_SE_A0 (引脚21) NC

5) A1 (引脚27) NC

6) VSADJ (引脚22) 、具有一个7.06K 电阻下拉电阻器

7) TX_TERM_CTL (引脚36) NC

8) PRE_SEL (引脚20)常闭

9) SWAP_POL (引脚1) NC

10) SPDIF_N (引脚45)、470K 电阻器拉取 down.e2e.ti.com/.../Intput_5F00_card-schematic.pdfe2e.ti.com/.../Card-block-diagram.pdf

非常感谢。

5 年多前

0 admin 5 年多前

TI__Guru**** 2522770 points

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您好！

FPGA 是否需要交流耦合？如果 FPGA 需要交流耦合、TMDS181输出端是否具有外部终端网络？

根据原理图、

OE 引脚具有内部弱上拉电阻、请在 OE 引脚上具有0.22uF 下拉电阻

对于灌电流侧、SDA_SNK 和 SCL_SNK 上是否有47k 上拉电阻？

谢谢

David

0 admin 5 年多前

TI__Guru**** 2522770 points

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尊敬的 David：

感谢您的快速响应。

1) 1)我在 FPGA 侧使用了直流耦合。

2) 2)我在 OE 引脚上使用了4.7K 外部上拉电阻、并连接到 CPLD 以进行上电复位。

3) 3) SDA_SNK 和 SCL_SNK 上拉电阻。

我当前的关键问题是 PC 已向 TMDS181发送时钟信号，但它没有向 FPGA 输出信号。

您是否有任何关于 TMDS181没有输出的建议？

非常感谢。

0 admin 5 年多前

TI__Guru**** 2522770 points

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您好！

如果 HPD_SNK 被驱动为高电平、那么它取决于 FPGA 内部的端接结构。 FPGA 是否具有50欧姆到3.3V 的端接电阻？

如果 FPGA 输入需要进行交流耦合、则 TMDS181输出和交流耦合电容器之间需要将外部50 Ω 端接电压设置为3.3V。

谢谢

David

0 admin 5 年多前

TI__Guru**** 2522770 points

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尊敬的 David：

将外部50 Ω 终端添加到3.3V 后、该问题得到了解决。感谢您的大力支持。

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