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[参考译文] SN65DSI86:如何进入 PHY_TEST_PATCH

Guru**** 657980 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1300489/sn65dsi86-how-to-enter-phy_test_pattern

器件型号:SN65DSI86
主题中讨论的其他器件:测试2

尊敬的 TI:

我在上拉 TEST2后执行以下操作。

chose operation:
[0]: HBR2 Compliance Eye Pattern
[1]: Symbol Error Rate Measurement Pattern
[2]: 80-bit Custom Pattern
[3]: Other: Setting Reg
[4]: Other: Read DPCD
: 0
set reg: [0A] = 00000010
now reg: [0A] = 00000010
we will use refclk 1
set reg: [94] = 10000000
now reg: [94] = 10000000
set reg: [93] = 00110100
now reg: [93] = 00110100
set reg: [FF] = 00000111
now reg: [FF] = 00000111
set reg: [16] = 00000001
now reg: [16] = 00000001
set reg: [FF] = 00000000
now reg: [FF] = 00000000
set reg: [5A] = 00000100
now reg: [5A] = 00000101
set reg: [0D] = 00000001
now reg: [0D] = 00000001
set HBR2_COMPEYEPAT_LENGTH reg (260): 260
set reg: [98] = 00000001
now reg: [98] = 00000001
set reg: [97] = 00000100
now reg: [97] = 00000100
now ENCH_FRAME_PATT = SR BF BF SR or BS BF BF BS
[0]: SR BF BF SR or BS BF BF BS
[1]: SR CP CP SR or BS CP CP BS
choose ENCH_FRAME_PATT (0): 0
set reg: [5B] = 00000000
now reg: [5B] = 00000000

[0] = Pre-emphasis level 0.
[1] = Pre-emphasis level 1.
[2] = Pre-emphasis level 2.
[3] = Pre-emphasis level 3.

set Pre-Emphasis Level (recommend 1): 0
set reg: [93] = 00110100
now reg: [93] = 00110100

[0] = Voltage swing level 0.
[1] = Voltage swing level 1.
[2] = Voltage swing level 2.
[3] = Voltage swing level 3.

set VOD level (recommend 1): 0
set reg: [94] = 10000000
now reg: [94] = 10000000

[0] = Post-Cursor2 Level 0 (0 dB) (Default)
[2] = Post-Cursor2 Level 1 (0.92 dB)
[4] = Post-Cursor2 Level 2 (1.94 dB)
[6] = Post-Cursor2 Level 3 (3.10 dB).

set post cursor2 (recommend 0): 0
set reg: [95] = 00000000
now reg: [95] = 00000000
set reg: [96] = 00000110
now reg: [96] = 00000110

现在桥接寄存器是

00000000:3638 4953 4420 2020 0200 8200 0001 0000 68ISD .
00000010:3e00 6500 0000 0000 0000 0000 0000 0000 >.e............
00000020:0000 0000 0000 0000 0000 0000 0000 0000 .........
00000030:0000 0000 0000 0000 0000 0000 0000 0000 .........
00000040:0100 0000 8000 0000 0000 0000 0000 .........
00000050:0000 0000 2000 40e4 0500 1000 9000 ...... .@……
00000060:A060 a400 0000 0000 0000 0000 0000 .`……
00000070:0000 0000 0001 0301 9009 0000 0000 .........
00000080:0000 0000 0000 001f 7cf0 c107 1f7c ......... |。。|
00000090:f0c1 0734 8000 0604 0100 0000 0000 ... 4 ...
000000a0:01ff ff00 0000 0000 0000 0000 0000 .
000000b0:0478 acac 086c 9c9c 0c5c 5c5c 0c0c 0c0c 0c0c .x...L...\\\……
000000c0:3f3f 0f00 0000 0000 0000 0000 0000?………
000000d0:0000 0000 0000 0000 0000 0000 0000 .........
000000e0:0000 0000 0000 0000 0000 0000 0000 .........
000000f0:0002 0000 0102 0000 0000 0000 0000 0000.0000

I 设置数据速率 HBR、但 波形为 hbr2 (5.4Gbps)

如果 I SET 数据速率为1.62Gbps、则 波形将为4.32Gbps

我发现波形在我进行 DP 锁定(0x0D)时出现、甚至不确定设置为 HBR2 (0x96)的模式是否有效、因为我没有看到显著的变化。

我仔细阅读了规范、找不到任何问题

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    您是否尝试过0x94寄存器中的任何其他设置? 似乎频率未正确对齐?

    尝试针对 HBR2图形运行此脚本、并在确认显示的图形是 HBR2图形后更改0x94寄存器。  

    这是一个 aardvark 脚本、但您也可以读取其中设置的寄存器、并转换为 I2C 控制器

    e2e.ti.com/.../HBR2_5F00_4DP_5F00_VOD0_5F00_PRE0_5F00_POST0_5F00_SSCOFF_5F00_COMPEYE.xml

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    在完成上述寄存器设置之后、我将0x94从0设置为 HBR2、值0具有与1相同的效果。

    0_1G62bps

    2_2G16bps

    3_2G42bps

    4_2G7bps

    5_3G24bps

    6_4G32bps

    7_5G4bps

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    在这些图中、这是 HBR2的模式吗? 如何确认这是 HBR2的模式。

    为什么在设置0x0D (PLL EN)之后发射波形、而在设置0x94之后不发射波形?
    您能否提供 HBR2测试波形的示例图?

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    嗨、Li:

    我无法通过查看示波器上的数据来确认测试模式。

    可以通过两种方法来验证测试图案是否正确:

       1) 1)使用协议分析器

       2) 2)使用合规性软件

    PLL EN 是输出(DP)时钟的使能引脚。 在设置 PLL_EN 之前、该器件不会输出任何内容、因为时钟是输出数据的先决条件。 更改频率将更改 TX 侧(也是 PLL_EN 侧)的内部时钟倍频器/分频器。  

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    您展示的 HBR2测试图形过度均衡、导致眼图出现凸起。 降低均衡设置以改善眼图。  

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    嗨、

    我们难道不需要根据文档进行设置吗? 是否有任何其他用于 HBR2测试的寄存器设置?

    谢谢。

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    尊敬的 TI:

    您之前给出的设置会导致示波器 EDP 自动测试错误。

    手动设置的 TX 摆幅代码和后置1预加重是否需要与实际的 EDP 面板训练参数一致?

    谢谢。

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    要确认测试图案是否正确、请务必使用上述方法。 确保数据速率、预加重和摆幅均与您正在进行的测试一致。 您可以在脚本中手动更改这些参数、