[参考译文] DS90CF366：LVDS 接收器时序

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https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1313023/ds90cf366-lvds-receiver-timing

器件型号：DS90CF366

您好、TI！

我将根据 snla249.pdf 方法计算 DS90CF366的 LVDS 接收器时序、并希望确认 Rspos 的含义以及 clk 周期到周期抖动对 Rspos 的影响。

从措辞中、Rspos0定义了选通的绝对最小和最大位置、例如、对于位0、Rspos0_min=0.49ns、Rspos0_max=1.19ns、Rspos0_typ=0.84ns、最大值最小值窗口=1.19-0.49=0.7ns
如果周期到周期抖动将典型选通位置移动到0.54ns、Rspos0_min 和 R应答器0_max 是否分别移动到0.19ns 和0.89ns (只需将窗口保持为0.7ns 即可？)？或者 Rspos0_min 和 Rspos0_max 仍然保持0.49ns 和1.19ns？

谢谢

文军

1 年多前

0 admin 1 年多前

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您好、Wenjun：

由于美国公众假期、我们的团队目前不在办公室、明天会回来。感谢您在此期间的耐心等待

此致、

凯西

0 admin 1 年多前

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您好、Wenjun：

可以使用应用手册第5页中的公式1和2来计算 Rspos_max 和 Rspos_min。

Unknown 说：
如果周期到周期抖动将典型选通位置移动至0.54ns、则 Rspos0_min 和 R应答器0_max 是否分别移动至0.19ns 和0.89ns (只需将窗口保持为0.7ns 即可？)？或者 Rspos0_min 和 Rspos0_max 仍然保持0.49ns 和1.19ns？

它的最小值和最大值仍然分别为0.49ns 和1.19ns。

此致、

G·阿巴尔卡

0 admin 1 年多前

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您好、Gil：

感谢您的回复！

换言之、我希望知道 clk 周期到周期抖动如何影响应用手册中排列1/2的左/右位裕度。

在我看来、 clk 周期到周期抖动会影响 Rspos_min/max 位置、然后进一步影响左/右位裕度、我不确定我的观点是否正确、需要与您确认。

谢谢

文军

0 admin 1 年多前

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您好、Wenjun：

Rspos_min/max 不受 clk 周期到周期抖动的影响。如果存在时钟周期到周期抖动、则最小和最大 rspos 与开关特性表中所述的相同、频率为85MHz。

时钟周期到周期抖动会影响 RSKM 值：

此致、

G·阿巴尔卡

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