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[参考译文] DP83867IR:如何改善失真?

Guru**** 2535750 points
Other Parts Discussed in Thread: DP83867IR

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1311248/dp83867ir-how-to-improve-distortion

器件型号:DP83867IR

您好!

我们的客户正在实验室内部进行"合规性测试"。

其中一项发现是通道 D 的失真仅为10mV 左右的测试限值。

您能建议我们如何通过设置寄存器值来改善失真吗?   

 

另一个问题是、在 snla239c 的第15页上、有如下说明。

             寄存器0x25 = 0x400 //单通道选择。 务必更改为接受测试的适当通道

             //400:通道 A

             //420:通道 B

             //440:通道 C

             //460:通道 D

这是否意味着在"合规性测试"中、我们不应该需要在所有通道活动条件下执行失真要求?

我们能否通过逐个通道激活的"合规性测试"?

此致、

望月市

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    您好、望月行:

    采用单通道测试已显示出与失真测试呈正相关。 客户可以利用此测试独立测试每个信道、而不会让其他信道影响被测信道的性能。

    此致、

    格罗姆

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    您好、Gerome、

    感谢您的提示回复。

    我们知道、单通道失真测试可以消除其他通道的影响。  

    此允许测试条件是否通过"合规性测试"?

     

    没有任何方法可以优化 DP83867IR 的失真性能。

    为了获得更好的失真、我们应该关注什么?不仅关注寄存器设置、而且关注其他硬件问题、比如 PCB 布局?

    此致、

    望月市

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    您好、望月行:

    使用这种情况时、我们未发现任何问题。 目前、我们的 布局指南中最出色的指导原则 是我们对布局的最有效经验。 1000Mbps 合规性测试本质上是一个非常复杂的测试、因为限制非常严格。  

    此致、

    格罗姆

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    Gerome,

    感谢您的支持。

    此致、

    望月市

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    您好、Gerome:

    我们又收到了客户的一个请求。

    他们希望在"合规性测试"条件下查看 DP83867 EVM 的测量结果。

    了解其 PCB 布局是否经过优化。

    此致、

    望月市

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    您好!

    我不能在这个论坛上说出这种数据。 相反、客户能否根据此布局检查清单共享其电路板布局设计?

    此致、

    格罗姆

    e2e.ti.com/.../2330.IndustrialPHY_5F00_Layout-Review-Checklist.xlsx

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    尊敬的 Gerom:

    非常感谢您的支持。

    我们将在私人邮件中分享客户的 PCB 布局。

    我已立即向您发送 E2E 好友发货申请。

    此致、

    望月市

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    尊敬的 Mochi:

    客户是否可以填写检查清单并发送? 这将有助于加快审查进程。

    此致、

    格罗姆