[参考译文] DP83848I：CPU 和以太网 PHY 无法通信。

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https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1323105/dp83848i-cpu-and-ethernet-phy-cannot-communicate

器件型号：DP83848I

尊敬的 TI 支持团队：

我们的客户正在评估 DP83848IVV、无法进行通信。

型号：DP83848IVV/NOPB
通信：MII
地址：00111

症状是 CPU 和以太网 PHY 无法通信。

在进行寄存器读取时、PHY 应该输出低电平、但保持高电平。
我将25MHz 时钟输入到 X1、但它不是从 CLK_OUT 输出。
数据表显示在 MII 通信期间输出25MHz。它保持低电平。

下面是 MDC 和 MDIO 通信期间的波形和电路图。

e2e.ti.com/.../DP83848I-Waveform-during-MDC_2C00_-MDIO-communication.pptx
此致、
由山浩明

5 个月前

0 admin 5 个月前

TI__Guru**** 1135610 points

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您好！

客户能否填写此原理图检查清单以帮助推进调试过程？

e2e.ti.com/.../7220.DP83848_5F00_Schematic_5F00_Design_5F00_Review_5F00_Checklist.xlsx

此致、

格罗姆

0 admin 5 个月前

TI__Guru**** 1135610 points

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大家好、Gerome-San。
感谢您的建议。

我们已将 Excel 文件发送给客户。
客户急于解决他们的问题。
因此、如果您是 myti 用户、您将直接从客户回复 E2E 设计支持接口论坛。

此致、
由山浩明

0 admin 5 个月前

TI__Guru**** 1135610 points

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您好！

感谢您的更新。我将等待他们的答复。

此致、

格罗姆

0 admin 5 个月前

TI__Guru**** 1135610 points

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您好 Gerome-San。

我们收到了客户的回复。

客户表示工作正常。

原因是硬件连接错误和电源反馈连接设计不正确。

客户在数据表项目7.2.1.3电源反馈中遇到连接错误。
为确保 DP83848I 正常运行、应将具有10 µF 和0.1 µF 值的并联电容放置在靠近器件的引脚23 (PFBOUT)的位置。引脚18 (PFBIN1)、引脚37 (PFBIN2)、引脚23 (PFBIN2)和引脚54 (PFBIN2)必须连接到引脚31 (PFBOUT)、每个引脚都需要一个小电容(1 µF)。有关正确连接的信息，请参阅下面的图7-4。

此致、
由山浩明

接口（参考译文帖）

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