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[参考译文] DP83867IR:关于 DP83867IR RGMII 接口的 PCB 布局问题

Guru**** 2386610 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1360481/dp83867ir-regarding-the-pcb-layout-problem-of-the-rgmii-interface-of-dp83867ir

器件型号:DP83867IR

大家好、团队

关于 DP83867IRRGZT 的 RGMII 信号、它们包括 TX_CLK、TX_D[3:0]、RX_CLK、RX_D[3:0]、 TX_CTRL、RX_CTRL、MDC、MDIO、INT_PWDN、 重置_N。 PCB 布局中的信号间隔要求是什么? 如果根据读取和写入进行分组、则为 MDC、MDIO、INT_PWDN、RESET_N 能否将它们分配到读取组或写入组? 还是一个单独的组? 非常感谢。

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    您好、Sheng、

    一般经验法则是、所有单端信号都需要以50欧姆特性阻抗进行布线、RGMII 的长度通常最多可达6"、但建议使用2英寸以下的阻抗。 间距建议未在 Stone 中设置、但一条良好的经验法则是 RGMII 迹线应彼此相差5 *(迹线宽度)。 对于复位/MDC/MDIO/PWDN、没有指南、因为它们是较低频率的信号。

    此致、

    格罗姆

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    您好、 Gerome。

    感谢您的答复。

    如下图所示、信号计划传输到连接器、连接器的引脚间距为0.5mm。 由于没有足够的引脚、因此我想删除一些 GND 引脚。 我认为仍然有必要保留时钟信号两侧的 GND 引脚。 能否移除图中引脚11的 GND? 是否需要将 GND 引脚与读取和写入信号隔离? 你有什么好的意见吗? 您能帮助我优化这种信号布局吗? 5W 线路间距良好、但难以实现。 谢谢。

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    您好、Sheng、

    我不知道在这里问。 此连接器上似乎存在所有必要的 RGMII 迹线。 我无法回答您关于需要 GND 在读取信号和写入信号之间进行隔离的问题、因为通常情况下、如果信号通过连接器、则不能服从间距、因为信号在如此小的面积内布线; 因此、它在信号链上本身就是缺陷。  

    此致、

    格罗姆

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    您好、 Gerome。

    感谢您的答复。

    由于连接器的引脚间距是0.5mm、我认为它可以满足3W 的线宽间距。 如果它是时钟信号引脚、则需要在两侧添加 GND 引脚。 如果是其他信号、是否无需添加 GND? 信号? 只使用引脚间距即可满足3W 的要求吗?

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    您好、Sheng、

    遗憾的是,我们没有关于这类主题的建议。 如前所述、由于所有信号都需要通过连接器压榨、因此不能避免超出间距限制;只能在远离连接器的大部分布线上存在该指导。

    此致、

    格罗姆