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[参考译文] TL16C750E:与 TL16C750兼容

Guru**** 2386620 points
Other Parts Discussed in Thread: TL16C750E, TL16C750
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/interface-group/interface/f/interface-forum/1360799/tl16c750e-compatibility-with-tl16c750

器件型号:TL16C750E
主题中讨论的其他器件: TL16C750

こんにちは。μ A

製品改訂に伴い、製品のUARTをTL16C750からTL16C750Eへの変更を検討しています。μ A

添付図のようにUARTと回路を変更したところ、起動時からSRAMへの書き込みができず、端末が暴走状態になってしまいました。しかし、TL16C750回路はそうではありませんでした。μ A

基板からUARTを取り外したところ、正常に動作したので、UART周辺の回路に問題があると思いました。μ A

デバイス起動時にUARTチップセットがディスエーブルされると、データバス端子はハイインピーダンスになりますが、実際にはデータバスは出力状態になっていました。μ A

その後、チップセットを有効にしてデバイスをリセットすると、データバスがハイインピーダンスになりました。μ A

データシートを確認しましたが、チップセットを有効にしてリセットするという記載はありませんでした。μ A

以下の点について教えてください。μ A

・TL16C750とTL16C750Eの相性 μ A (端末機能の違いなど μ A)

・起動時やリセット時の挙動についてですが、この挙動は正しいですか μ A?

ありがとうございます。μ A

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    您好!

    我无法理解您在帖子中提供的其他信息、但我确实看到帖子的标题是英文的。

    TL16C750的 E 版本具有许多额外的寄存器。 过去我们已经发现、当客户试图从较旧的器件改用较新的器件时、有时新的寄存器映射添加/规则会导致与以前的软件发生冲突。  

    我们始终建议客户测试新器件以查看其软件是否兼容、在某些情况下、计时差异还可能导致较旧的现有固件与较新器件不兼容。  

    如果您遇到问题、并且能够获得示波器屏幕截图、提供某种伪代码或修改现有软件、我们可以尝试帮助您调试所遇到的问题。  

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    抱歉。 该案文已转换为日文。
    重新发送。

    由于产品修订、我们正在考虑将产品的 UART 从 TL16C750更改为 TL16C750E。
    当我更改了随附图中所示的 UART 和电路时、从启动开始就无法写入 SRAM、终端进入失控状态。

    当我从板上移除 UART 时、UART 会表现正常、所以我认为 UART 周围的电路存在问题。
    当 UART 芯片组被禁用时、数据总线端子变为高阻抗、但数据总线实际上处于输出状态。
    然后启用芯片组并重置器件、数据总线变为高阻抗。
    我查看了数据表、里面没有提到芯片组的启用和复位。

    请告诉我以下几点。
    ・TL16C750与 TL16C750E 之间的兼容性(引脚功能差异)
    ・关于启动和复位时的行为、这种行为是否正确?

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。
    我查看数据表后发现未提及启用和重置芯片组。

    当 Vcc 斜升时、器件应该已经经历了一个复位。 通常情况下、在为大量数字的设备上电后切换 RESET 是一种好方法。 以确保在发生错误的 POR 时使用默认值。

    ・关于启动和重置时的行为、此行为是否正确?

    我个人没有看到这种问题发生。 我建议仔细检查 IOR 引脚和器件的 Mode 引脚、确保 IOR 不为低电平且模式为高电平。 如果您使用的 Mode 为低电平、则需要 IOW 低电平或 CS 高电平。 这是并行输出引脚输出一些东西的2种方式。  

    我知道器件是否未通电、以及您的任何输入引脚(例如 D0-D7)是否处于逻辑高电平、它可能会泄漏/返回偏置至器件中。  

    ・TL16C750与 TL16C750E 之间的兼容性(引脚功能差异)

    我在之前的帖子中提到过这一点、但我们并不能真正保证与这两个器件向后兼容。 过去、我们看到的情况是、较新器件中的新寄存器有时会在使用较旧器件固件时导致软件问题。

    -鲍比

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    您好、Bobby。

    我个人没有遇到过这种问题。 我建议仔细检查 IOR 引脚和器件的 Mode 引脚、确保 IOR 不为低电平且模式为高电平。 如果您使用的 Mode 为低电平、则需要 IOW 低电平或 CS 高电平。 这是并行输出引脚输出一些东西的2种方式。  [报价]
    I CHECK、IOR 和 MODE 为高电平。
    MODE 引脚被拉至 VCC (3.3V)。
    [报价 userid="284552" url="~/support/interface-group/interface/f/interface-forum/1360799/tl16c750e-compatibility-with-tl16c750/5195451 #5195451"]我知道该器件是否未通电并且您有任何输入引脚(如 D0-D7处于逻辑高电平)、它可能泄漏/反偏置到器件中。
    在电源之前、D0-D7全部被拉至 GND、该逻辑为低电平。
    该位在上电后立即变为未定义、在初始化处理后变为高电平。
    继续输出数据总线会导致与 SRAM 争用、因此无法再写入 SRAM。
    我们目前正在确认对寄存器的更改。
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    我们目前正在确认对注册所做的更改。

    您是否可以在复位前进行寄存器读取、然后在复位切换后重复并读取寄存器以验证您是否看到任何更改?  

    您是否还可以在750E 上电时提供 Vcc 电源轨的波形? 我想确保您在合理的时间内从 GND 给 Vcc 加电。

    -鲍比

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    您好、Bobby。

    您能否在给750E 加电时提供 Vcc 电源轨的波形? 我想确保您在合理的时间内从 GND 加电至 Vcc。

    提供了 Vcc 和 D0波形。  黄色是 Vcc (3.3V)、蓝色是 D0。

    第一幅图显示了从上电到复位处理的波形。
    第二幅图显示了接通电源时的波形。

    正如我在第一篇文章中所提到的、当 CS 在上电或复位时短接至 GND 时、我还将提供波形。

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    您好!

    鲍比目前不在办公室,但将返回 参加这个调查 下周。  

    此致!

    Parker Dodson

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    在上次发送的图像中、D0在电源打开后200ms 波动。 这个等待时间由 RESET IC 引起、并且我们已经确认它的运行方式符合规定。
    另外、750E 数据表建议使用1µF 旁路电容器、因此我将其更改为这、但行为没有明显的变化。

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    您好!

    我觉得上电(Vcc)波形可以、从我可以看到的角度来看、假设分频正确、它大约在10ms 后从 GND 变为 Vcc。

    [报价 userid="605976" url="~/support/interface-group/interface/f/interface-forum/1360799/tl16c750e-compatibility-with-tl16c750/5211647 #5211647"]
    第一幅图显示了从上电到复位处理的波形。
    第二幅图显示了接通电源时的波形。

    [报价]

    您是说复位发生 在 D0开始切换之前、还是说它开始切换之后?

    从示波器截图上看、D0引脚可能与其他连接到网络并将其驱动为低电平的引脚发生争用。 (引脚看起来卡在2V 左右)。  

    为了我的理解、  

    当器件首次上电时、您会看到数据引脚为输出、即使 CS 被禁用且 IOR 保持高电平也是如此。 如果您切换复位、数据引脚将像预期的那样变为高阻抗。  

    这种说法是否正确?

    -鲍比

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    您是说复位发生 在 D0开始切换之前、还是意味着它开始切换之后?

    上电后或手动按下 RESET 按钮时、RESET IC 保持运行200ms。 在不使用时、D0-D7被上拉至 Vcc、这可能就是它们被固定在大约2V 的原因。

    [报价 userid="284552" url="~/support/interface-group/interface/f/interface-forum/1360799/tl16c750e-compatibility-with-tl16c750/5228320 #5228320"]

    为了我的理解、  

    当器件首次上电时、您会看到数据引脚为输出、即使 CS 被禁用且 IOR 保持高电平也是如此。 如果您切换复位、数据引脚将像预期的那样变为高阻抗。  

    这种说法是否正确?

    [报价]

    可能是这样。 在复位状态下、D0-D7变为高阻抗、并且在 CPU 初始化操作(D0波动的部件)完成后不返回高阻抗。

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    我想可以为这个器件装配一个 EVM。 我可以尝试为器件加电、看看在切换 RESET 引脚之前 D0引脚是否是输出。  

    不过要确定的是、在切换复位之前或在复位期间、您可以看到 D0引脚作为输出、此时器件处于复位状态200ms。

    -鲍比

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    [报价 userid="284552" url="~/support/interface-group/interface/f/interface-forum/1360799/tl16c750e-compatibility-with-tl16c750/5231106 #5231106"]不过为了确定这一点、您是在切换复位前或者在复位期间(器件保持复位状态200ms)看到 D0引脚充当输出。[/QUOT]

    复位状态期间、UART CS、IOW 和 IOR 引脚均上拉至 Vcc。 实际测量时、观察到每个 LDO 具有3.3V (Vcc)电压、因此 D0-D7被视为既不处于输入状态、也不处于输出状态。

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    感谢您的澄清、我将在一周结束之前在实验室中尝试对此进行测试。 如果我看到类似的东西、我会让您知道。

    -鲍比

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    我已尝试通过将 RESET 引脚保持在高电平来重复您在 D0引脚上看到的情况、但未看到 D0引脚的行为有任何不同。 在切换 RESET 之前和之后、我看到 D0引脚悬空到 GND。

    我下周将重试、再稍微修改一下我的板、看看它是否有任何变化。  

    -鲍比

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    您好、Bobby。

    关于使用 EVM 进行确认、之后发生了什么?

    如果您能回答、我将不胜感激。

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    很抱歉、我忘了给您更新。 我再次进行了尝试、但看到了相同的情况、当切换 RESET 引脚时、D0-D7引脚的行为似乎没有任何不同。 我不确定这是我这边还是你这边的设置问题。  

    如果您认为这样会有所帮助、我可以尝试订购一块分线板、然后尝试在此基础上重复测试。 请告诉我、我需要与我的管理员一起尝试订购分线板。

    -鲍比