主题中讨论的其他器件:TRS3232、
工具与软件:
我已经在 DIN2引脚10悬空的情况下安装了许多带有 TRS3232EQPWR 元件的板、我想我没有读完您的数据表、其中表明未使用的输入已连接好、但它似乎只有 RIN 引脚。 我注意到在博客中、必须断开未使用的 DIN 引脚、为什么? 是为了 EMI、另一个 TRS3232通道最终不会失效、换句话说、使 DIN 引脚悬空有什么危险?
BTW、如果它是必需的、那么为什么数据表中没有规定不让 DIN1or2引脚悬空?
BR、
Scott
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工具与软件:
我已经在 DIN2引脚10悬空的情况下安装了许多带有 TRS3232EQPWR 元件的板、我想我没有读完您的数据表、其中表明未使用的输入已连接好、但它似乎只有 RIN 引脚。 我注意到在博客中、必须断开未使用的 DIN 引脚、为什么? 是为了 EMI、另一个 TRS3232通道最终不会失效、换句话说、使 DIN 引脚悬空有什么危险?
BTW、如果它是必需的、那么为什么数据表中没有规定不让 DIN1or2引脚悬空?
BR、
Scott
Scott、您好!
[报价 userid="589942" url="~/support/interface-group/interface/f/interface-forum/1448377/trs3232e-q1-trs3232wqpwrq1 "]我注意到在博客中、必须断开未使用的 DIN 引脚、为什么? 是为了 EMI、另一个 TRS3232通道最终不会失效、换句话说、使 DIN 引脚悬空会有什么危险?否、如果 DIN 引脚悬空、器件本身不会发生故障或损坏。 这对于 RS232器件来说实际上都不是 EMI 问题、因为 DOUT 引脚的压摆率控制在30V/us 以下(标准的一部分)。 这种情况的主要原因是、如果 DIN 引脚悬空到 Vcc 和 GND 之间的值(最坏情况是 Vcc/2)、则会消耗更多电流。 我的意思是、内部 CMOS 输入将半偏置、此时 PFET 将略微导通、NFET 将略微导通、从而导致更多的漏电流。 过去、当我在对 I2C 器件进行研究时、我看到每个浮点输入约为30uA。
[报价 userid="589942" url="~/support/interface-group/interface/f/interface-forum/1448377/trs3232e-q1-trs3232wqpwrq1 ">BTW、如果它是必需的、那么为什么数据表中没有说明它不应使 DIN1or2引脚悬空?[/QUOT]在功耗并不重要的终端设备中、这并不是必需具备的功能、因为它是通过插头供电的。 需要低功耗的终端设备是电池供电的设备、这些设备可能根本不会使任何输入悬空。 这种情况不仅适用于 RS232 TTL 输入、还适用于所有 TTL 高阻态输入。
-鲍比
当允许 IN 输入悬空时、则会得到较大的击穿电流(可能是大得多的 mA、具体取决于器件)、并且器件可能会发生故障或损坏。 请参阅 [常见问题解答]慢速或浮点输入如何影响 CMOS 器件?
你好,我很困惑你鲍比和你克莱门斯似乎不在同一个页面上与答案。 BTW 在此时研究了几个电路板、输入 DIN2似乎始终保持在接地端、几乎就像它被拉低一样、但我的 DMM 通过测量输入阻抗开路、证明情况并非如此。 器件的结构中是否有有助于将悬空输入拉至低电平的器件? 可以确保为器件提供少量额外的电源电流以处理悬空输入、这并不会打扰到我。 我要尝试确定的是、我是否需要返工电路板、以在引脚之间使用焊点将 DIN2输入连接到 DIN1、从而避免对器件造成任何损坏?
输入是对称的、并且会在随机电压下浮动。 输入电容极低、所以 DMM 的输入阻抗会将输入拉至基准电压;当您测量输入和 VCC 之间的电压时、测得的值应该很高。
此处的 示例 表明、悬空的未使用通道使反相器像同相缓冲器一样工作。 TRS3232E-Q1可能更加稳健、也可能不更加可靠。
Scott、您好!
有时、添加示波器/DMM 会增加您观察到的节点中的泄漏电流(不过、泄漏电流通常非常低)。 器件本身可能具有某种程度的少量漏电流、该电流可能会将其拉至 GND、但器件也可能因器件而异。 您还可能会看到电压在更高的噪声环境中波动。
我个人认为、此处的浮动输入不会导致完全故障、因为击穿电流很小、不会产生过多热量。 也许如果这里有大量悬空输入、额外的漏电可能会导致明显的发热、但通过一个引脚、我认为它将非常小。
我想如果您出于其它原因而必须重新制造电路板、您可以将输入偏置为已知值、但是如果您不用担心输入产生的泄漏电流、我认为没有必要仅仅进行完全旋转来偏置悬空引脚。
-鲍比