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[参考译文] ISO7740:需要外部电路来防止 ISO7740F 在加电时出现毛刺脉冲

Guru**** 2390100 points
Other Parts Discussed in Thread: TPS3106-EP
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/isolation-group/isolation/f/isolation-forum/766371/iso7740-external-circuit-needed-to-keep-iso7740f-from-glitching-on-power-up

器件型号:ISO7740
主题中讨论的其他器件:TPS3106-EP

当 Vcco < 2.25V 时、ISO7740F 的输出在数据表的表2中列为"未定"。

是否有任何方法来排列器件(也许使用外部组件)、以便在施加 Vcco 时不会出现毛刺脉冲(变为高电平)? (假设 EN 保持低电平、VCCI 可以断电或以输入低电平通电)

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    您好、Steve、

    当输入信号或 VCCI 丢失时、ISO7740F 会将输出引脚保持在低电平、因此这是防止输出错误变为高电平的正确部件。 为了在上述条件下增加输出将为低电平的安全层、可以在输出端添加一个100kOhm - 1MOhm 下拉电阻器。

    请告诉我们这是否有帮助!


    感谢您在 E2E 论坛上发帖、
    Manuel Chavez
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    谢谢 Manuel!

    即使 Vcco < 2.25V、也是如此吗? 这似乎与数据表指导相矛盾。
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    Steve、

    不用客气! 数据表表中未涵盖具有外部组件的情况、例如下拉或上拉电阻器。 即使输出引脚上的电压不确定、添加下拉电阻也会将输出路径接地。

    我们希望防止的干扰的振幅和持续时间是多少? 在前面提到的表格条件下进行的基准测试显示、在启动时输出引脚上的电压为300mV 或更低、时序顺序为微秒和纳秒、如下图所示。 由于这些振幅低于大多数阈值、因此预计不会打开任何外部组件。



    我将等待您的答复。


    谢谢、
    Manuel Chavez

    P.S. 为了清晰起见,对该帖子的文本进行了编辑

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    谢谢 Manuel!

    基本要求是防止 MOSFET 栅极开关。 阈值电压为~ 1.1V、因此如果我们小于650mV、这可能就足够了。 测试数据看起来很有希望、但从提供的数据中不清楚、在 Vcc2轨的不同 dv/dt 或整个 PVT 下、输出可保证保持在650mV 以下。 我想问题是、我们说输出"无法确定"、这可以理解为意味着输出可以在 Vcc2 < 2.25V 的情况下驱动高电平。 如果情况并非如此、请告知我们。 由于这是一个非常关键的应用、因此需要保证运行。

    我们建议的替代方案是使用单独的 TPS3106-EP 监控器、以便在0.4<Vcc2 < 2.25V 时使 FET 保持关断状态。 该器件的额定工作电压较低。
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    不用客气、Steve!

    感谢您在本次回复中提供的详细信息。 在数据传输之外、ISO7740F 不需要高输出、但请给我2-3天时间来查看电压监控器并与隔离团队核实。 同时、深入了解以下问题将会有所帮助。

    Vcco 预计何时低于2.25V?
    FET 的导通时间是多少?


    尊敬的、
    Manuel Chavez

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    FET 可以在10-20nsec 范围内导通
    无论 VCCI 状态如何、加电或断电时 VCCO 可能低于2.25V
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    您好、Steve、

    上一篇文章中所附的波形是在加电期间捕获的、但从那时起、我无法在实验室中再现波形、以测试我们提出的解决方案。 输出上的摆动因器件间的差异以及 ISO7740F 所处的 PCB 环境而异。 我们的团队建议在输出引脚上使用10kOhm 下拉电阻器来帮助减少电压波、并联添加~0.1nF 的小电容器有助于进一步减少任何电压摆动。 监控器 IC 是一种有效的解决方案、它可能是过度使用的。

    我们可以继续测试以检查这些解决方案是否良好;请告诉我您或我们的客户是否希望我们继续。


    周末愉快!
    Manuel Chavez

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    谢谢 Miguel -即使通过主管、也能通过可追溯的规范来保证。 我们将推荐这种方法。