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[参考译文] PMP23391:针对 Fsw 变化的控制环路补偿调整:500kHz 至 100kHz

Guru**** 2652575 points

Other Parts Discussed in Thread: PMP23391

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/logic-group/logic/f/logic-forum/1591258/pmp23391-control-loop-compensation-adjustment-for-fsw-change-500-khz-to-100-khz

器件型号: PMP23391

您好:

我计划基于 TPS7H5005 器件实现稍作修改的 PMP23391 参考设计版本。

原始设计配置为在  500kHz 的开关频率 (Fsw) 下运行。 但是、我所构建的转换器将接收  200kHz 的外部同步信号 (SYNC)、并在内部以 100kHz 的开关频率运行。

我知道、大幅降低  FSW 需要改变控制器补偿元件的值。 虽然最终优化需要电路内调试和调优、但我寻求建议来为补偿网络设计建立一个良好的起点。

由于开关频率已降低、我认为控制环路的零点和极点频率(使用内部/外部 OTA 实现)也应相应地下调。 我怀疑这会涉及增加补偿电路中的电阻和/或电容值、以实现所需的较低交叉频率 (fc)、但我不确定所需的变化幅度。

请提供:

  1.   fsw = 100kHz 时补偿电阻器和电容器(例如,R112、C111、C112、如典型 II 型网络所示)的建议起始值

  2. 或者、PMP23391 的控制到输出传递函数是否可用、使我能够通过分析计算新的补偿分量?

感谢您的帮助。