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[参考译文] SN74LV4T125:连接到输出引脚电压的 GPIO 上拉电阻器问题

Guru**** 656470 points
Other Parts Discussed in Thread: SN74LV4T125
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/logic-group/logic/f/logic-forum/1087351/sn74lv4t125-gpio-pull-up-resistor-connected-to-output-pin-voltage-question

部件号:SN74LV4T125

我有几个输出引脚连接到 GPIO。

默认情况下,这些 GPIO 将电阻器上的电阻器打开至3V3。

VCC 连接至3V3。

我测试了输入针脚上的电压,该针脚没有连接到任何针脚,它们显示的电压略高于2V。

在这种情况下这是正常的。

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    CMOS 输入具有高阻抗,切勿浮动。 请参阅 [FAQ]慢速或浮动输入如何影响 CMOS 设备?

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    谢谢,

    在生产中,它们上的输入设备将具有已知电压。

    既然如此,您认为我不需要 GPIO 上的上拉或下拉电阻,对吗?

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    如果输入可以随时浮动(而 SN74LV4T125已通电),则需要一个上拉/下拉电阻器来防止它发生。

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    我想你说,你的初步回答绝不能让你的意见浮起水面。 回到我原来的问题, 我在 GPIO 上有一个上拉电阻器3.3V,该电阻器连接到此部件的输出引脚,其输入引脚未连接到任何部件。 3.3V 是连接到 VCC 的。 当我用万用表测量未连接的输入针脚时,其上的电压小于3.3V,即使没有任何连接。  

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    杰拉德:

    夹板正确,输入不应浮动。 如果您将一个引脚保持未连接状态,则该引脚处于浮动状态。 如果引脚不在定义的逻辑级别(高或低),则可以连接引脚,也可以浮动。  如果要连接到 SN74LV4T125输入的设备并非总是驱动线路高或低,则必须使用上拉/下拉电阻器将输入保持在定义的状态(高或低)。  

    此致,

    塞巴斯蒂安  

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    太棒了,效果很好。

    当输出连接到启用了3.3V 上拉的 GPIO 时,未连接的输入具有此电压也是正常的。 我只是想确保这是正常的。 在生产中,我将连接输入设备,而不需要上拉,但我只是想了解当输出引脚连接到具有3.3V 上拉的 GPIO 时,断开的输入引脚是否有电压。  

    我提出这一问题是因为我正在测试原型板,我们已经回来并希望确保。

    谢谢

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    杰拉德:

    如果您将输入保持未连接状态,则输入将处于浮动状态。 电压被称为“浮动”,因为它很容易受到附近信号和泄漏电流的影响,从而导致该输入引脚处的电压未知。 这就是为什么您在输入引脚断开连接时会读取其上的电压。 请参阅此常见问题 解答什么是浮动输入? 了解更多详细信息。  

    此致,

    塞巴斯蒂安  

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    感谢您的澄清。 只是为了澄清,断开的输入引脚上的电压超过2伏。 这听起来是否正确,2伏的泄漏可能会影响到该输入针脚。  

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    杰拉德:

    由于寄生虫,浮节点通常在 Vcc/2周围,但它的高度可以是 Vcc,也可以是 GND。  

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    感谢帮助我理解这一点。  

    我选择了用于主板的部件,因为我将为信号为5V 的输入设备布线,并且我希望部件将其丢弃到3V3以保护我们的芯片。 因此,当我将5V 信号设备连接到输入引脚时,其输出引脚应为3V3,哪一个是连接到 GPIO 的?

    根据上述要求,此部件号是否会执行此作业。 我对此很陌生,因此我对重复的问题深表歉意,并非常感谢这里提供的所有帮助。

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    我很高兴能提供帮助。 是的,此设备将从5V 转换为3.3V。

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    谢谢,解决了这一问题