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[参考译文] SN74LVC1G123:关于输出脉冲持续时间与外部时序电容曲线

Guru**** 2522770 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/logic-group/logic/f/logic-forum/976607/sn74lvc1g123-about-output-pulse-duration-vs-external-timing-capacitance-curve

器件型号:SN74LVC1G123

您好!

您能告诉我数据表中的图3和图4吗?

1.这应该是 Rext 而不是 RL、不应该呢?
2.您能告诉我如何选择 Rext 和 Cext 以及如何计算它们吗?



此致、
Yusuke

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    你好、Yusuke、

    是的、这些图中的 R_L 将是进入 Rext 的电阻器。 电阻器本身应标记为 R_T、因此数据表中对其错误标记、因此我们需要返回并更新它。  

    至于选择正确的 C_T 和 R_T 值、在调用 Cext 和 Rext 时、您需要首先选择所需的脉冲宽度、 然后、您需要从图6、C_T 和 R_T 中选择 K 系数的组合、该组合将根据此处的公式得出:

     
    谢谢、
    Rami

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    您好 Rami、

    感谢您的友好支持。
    请问 还有其他问题吗?

    >tw = K * R * C
    Rext 有上限吗?

    数据表仅指定最小值。
    您能给我一些关于最大值的建议吗?



     此致、
    Yusuke




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    你好、Yusuke、

    理论上没有上限。 设置最小值时、电流消耗不会损坏芯片、因此上限不是真正的问题。 当然、您必须考虑到对无源器件尺寸、价格和容差的权衡。 值越高、容差允许的变化越大、因此您的计时精度会降低。  也就是说、5k 的1%容差不会与50k 的1%容差具有相同的效果。  较大的电阻值通常在物理上也较大。 在选择最适合您的应用的值时、您需要考虑这些因素。  

    谢谢、
    Rami