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[参考译文] SN74ALVCH16827:输入为高电平且电源电压未连接时的缓冲器输出逻辑状态。

Guru**** 675400 points
Other Parts Discussed in Thread: SN74ALVCH16827
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https://e2e.ti.com/support/logic-group/logic/f/logic-forum/982103/sn74alvch16827-buffer-output-logic-state-when-input-is-high-and-supply-voltage-is-not-connected

器件型号:SN74ALVCH16827
主题中讨论的其他器件:SN74ALVTH16827

为了将 LVTTL 信号缓冲到 FPGA、我使用此 TI 缓冲器 SN74ALVCH16827DGGR。缓冲器 IC 放置在与 Zynq 母卡配合使用的基于 FMC 的 IO 卡上。 我在这里面临的问题是、当向缓冲器 IC 施加输入信号时、即使该 IC 没有电源、也会有输出信号。 输出使能信号连接到 PCB GND。 我想避免这种情况、因为它可能会损坏 FPGA。 有人能用解决方案建议我吗?

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    Saikumar、

    器件断电时、是否将/OE 引脚拉高? 这有助于确保器件在断电/上电时处于高阻抗状态。  

    谢谢、
    Rami

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    我已通过将使能引脚直接接地来启用 IC、而未在#OE 引脚上提供任何上拉电阻。

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    Saikumar、

    此器件没有"部分断电"功能。 如果您想使用此器件、则需要将/OE 引脚保持在高电平、直至其通电以确保高阻态。
     有20通道器件具有此功能、例如 SN74ALVTH16827、它将在 Vcc 介于0和1.2V 之间时将缓冲器保持在高阻态。

    谢谢、
    Rami

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    Rami、

       谢谢你。 我已订购器件 SN74ALVTH16827。 将在我接收到 IC 后测试电路。

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    这种局部断电功能有所帮助、但我在该 IC 上遇到了另一个问题。 当我施加大于1.7V 的信号输入时,即使输入增加到3.3V,输出仍保持在1.65V。 由于该 IC 是缓冲器、因此输出应与输入相同。 我有点困惑。 有人可以指导我完成这个过程吗?

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    这是一个数字缓冲器、它是低电平或高电平;输出电压由电源电压决定。

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    我为 IC 提供正3.3V 电压。  根据数据表、VOH 应为 VCC-0.2。 但在本例中、输出高电压固定为1.65V。 除了衰减之外、我没有在上述 IC 中添加任何无源电路。 已将输出使能引脚连接至电路板接地。 我的设计中是否缺少任何内容。 请给出建议。 谢谢你。

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    要么电源电压不是您认为的电压、要么输出短接至另一个驱动低电平的输出。

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    您能否提供设置原理图? 这样、我就可以看到这里是否有任何东西您可能会错过。

    谢谢、
    Rami

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    我要附上原理图以供参考。 缓冲器部件从 SN74ALVCH16827更改为 SN74ALVTH16827、以实现局部断电功能。 我已经使用万用表测量了电源、它是3.3V。

    Schematic 

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    电源电压不错。 如前所述、输出引脚与另一个输出短路、在目视检查中未观察到这种情况。 稍微向上触摸、现在工作正常。 谢谢你。