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[参考译文] 具有可调延迟时间的缓冲器

Guru**** 1687510 points
Other Parts Discussed in Thread: SN74LVC1G123, SN74LVC1G58
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/logic-group/logic/f/logic-forum/957755/buffer-with-adjustable-delay-time

主题中讨论的其他器件:SN74LVC1G123SN74LVC1G58

各位专家、您好!

我是否可以知道我们是否有任何逻辑缓冲器可以支持以下要求? 它们希望延迟输入信号的可调时间。 非常感谢!

此致、

Ann Lien

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    可以使用从下降沿触发的 SN74LVC1G123等器件生成0ms~100ms 脉冲。 然后、您需要使用输入信号对其进行或运算。

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    大家好、Clemens、

    请允许我帮您生成块、因为我们不熟悉 SN74LVC1G123。 非常感谢!

    此致、

    Ann Lien

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    请参阅 使用 SN74LVC1G123单稳多谐振荡器进行设计的第4.2.2.2节中的下降沿检测器。 将输出与输入与或门相结合。

    或者、您可以在施密特触发器或门(例如 SN74LVC1G58)的一个输入上使用 RC 延迟来仅延迟下降沿。 由于开关阈值的宽松容差、延迟时间没有得到很好的控制: