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[参考译文] SN74AVC4T774:器件断电时的 I/O 阻抗

Guru**** 2587365 points


请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/logic-group/logic/f/logic-forum/947579/sn74avc4t774-i-os-impedance-when-device-is-powered-down

器件型号:SN74AVC4T774

您好!  

 SN74AVC4T774RSV 的数据表规定器件专用于部分断电、Ioff 电路在器件断电时禁用输出。  

这是否意味着在 完全断电(VCCA 和 VCCB 都处于 GND)时可以安全地驱动 SN74AVC4T774RSV 的输入?  

我是否需要担心电流流经内部保护二极管流向 VCCA 或 VCCB?   

谢谢、

Alex

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    该器件没有连接到 VCC 的保护二极管。 请参阅 [常见问题解答]我的逻辑器件的输入电压(VI)是否可以高于电源电压(Vcc)?

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    好的、这是否意味着我可以在器件完全断电时安全地驱动器件输入? 在这种情况下、输入是否具有高阻抗?  

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    是的。

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    好的、谢谢。  

    因此、为了确保我了解器件的正常运行、以下陈述是否正确?  

    如果 I/O 配置为输入、则无论器件是否完全通电、部分通电或根本未通电、它都将始终具有高阻抗。

    2.如果 I/O 配置为输出、则如果器件部分通电或根本未通电(无论 OE 引脚如何)、则会具有高阻抗。  

    3.如果器件已完全通电、则输出状态仅由 OE 引脚决定。  

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    是的。