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[参考译文] SN74LV595A：当 VCC = 0V 时、输出上拉至3V3

admin
Guru**** 2386610 points
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https://e2e.ti.com/support/logic-group/logic/f/logic-forum/917342/sn74lv595a-output-pulled-up-to-3v3-while-vcc-0v

器件型号：SN74LV595A

尊敬的逻辑团队：

我的客户在输出端使用带有上拉电阻器的 LV595A、以使输出始终保持已知状态(避免高阻态)。 如果在输出上拉时 VCC = 0V、我是否会通过推挽输出的高侧 FET 产生潜在的反向泄漏？ 如果是、FET 可以处理多少电流？

与此相关的是、何时需要高阻态输出？ 根据我的理解、仅在 OE 被拉高时。  

谢谢、

Leo

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    TI__Guru**** 2386610 points
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    如绝对最大额定值表中所示、在高阻抗状态(仅当 OE 为高电平时)或在断电状态下允许高于 VCC 的电压。

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    TI__Guru**** 2386610 points
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    谢谢、

    我猜我们将看到从输出返回到高侧的反向电流、对吧？

    Leo

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    该电流被指定为 IOZ 和 Ioff。

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    TI__Guru**** 2386610 points
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    IOZ 在 VCC = 5.5V 时指定、IOFF 是我要查找的值。 谢谢你。  

    为了验证、该器件可支持高达5uA 的反向电流。 如果不建议这么做、对吧？  

    回到 Hi-Z、我不应该在高 OE 之外的任何其他情形中期望这种状态-正确吗？

    Leo

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    TI__Guru**** 2386610 points
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    "支持"是错误的词。 这不是 µA 要求、而是电气特性：当您施加高达5.5V 的电压时、泄漏电流将小于5 μ A。 (这是最极端温度下的最坏情况值；预期为 nA。)

    低泄漏电流意味着引脚具有高阻抗。