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[参考译文] SN74GTL2014:高阻态状态

Guru**** 2382630 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/logic-group/logic/f/logic-forum/595373/sn74gtl2014-hi-z-status

器件型号:SN74GTL2014

您好!

   客户希望了解保证  GTL2014输出侧为高阻抗或不为高阻抗的详细条件。 您能否帮助提供什么条件将是芯片的高阻态状态? 谢谢你。  

  在情景下、
  VCC 在 Vref 之前上升
   A. DIR 上拉至 Vcc
   b. DIR 连接至 GND
 2. Vref 在 Vcc 之前上升
   A. DIR 上拉至 Vcc
   b. DIR 连接至 GND    

BR

Patrick

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    尊敬的 Patrick:

    GTL 在没有任何输出使能引脚的情况下未指定为高阻态、除非当 dir 到 Vcc 时、A 端口到 B 端口的方向可以在 A 端口上以高电平进入高阻态。
    否则,它将是不确定的。