[参考译文] SN74LVC74A-Q1：用于保证数据保持丢失的最大电源电压

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https://e2e.ti.com/support/logic-group/logic/f/logic-forum/609781/sn74lvc74a-q1-maximum-supply-voltage-to-guarantee-data-retention-is-lost

器件型号：SN74LVC74A-Q1

我有一个设计、在该设计中、我需要保证 FF 将在电源轨上出现欠压情况后也会进入逻辑0状态。在断电期间、电源电压以 RC 的方式衰减、因此需要一些时间才能降至0V。我看到在1.5V 时有用于数据保持的最小电源电压。断电期间可保证数据保持丢失且器件将在逻辑0状态下恢复供电的最大电源电压是多少？

6 年多前

0 admin 6 年多前

TI__Guru**** 1120820 points

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您好 Farhan、

发生此欠压时、PRE 或 CLR 引脚是否会被拉低？
如果 PRE 和 CLR 引脚在整个欠压周期内保持高电平、则 FF 的输出状态将未知。这意味着如果器件断电并且 PRE 或 CLR 不为低电平、则启动时输出将处于未知状态。我怀疑这可能是一个更大的问题、因为即使断电、PRE 和 CLR 也需要分别为 H 和 L、在这种情况下、无论欠压条件如何、都需要将它们设置为该值。

因此、无论什么、都需要将 CLR 线拉低。
关于保证数据丢失的最小电源电压的具体问题、遗憾的是我们不测试此参数、因此它可能因器件而异、因此不建议在这种情况下进行设计。

是否有迹象表明器件存在欠压情况？直流/直流是否具有发送标志的欠压检测功能？如果是这样、您可以将该信号与 CLR 输入合并、这样当该信号变为低电平时、它将把 CLR 引脚驱动为低电平、从而复位输出。

但愿这有所帮助。如果您有其他问题、请告诉我。
最棒的
Michael

0 admin 6 年多前

TI__Guru**** 1120820 points

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您好、Michael、

PRE 和 CLR 引脚均上拉至电源轨。当电源恢复到3.3V 时、低至0.8V 的电源欠压是否不能保证逻辑0状态？

3.3V 稳压器的电源正常开漏引脚可连接至 CLR、这将保证 CLR 保持低电平、直到电源电压>3V。

法罕

0 admin 6 年多前

TI__Guru**** 1120820 points

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您好 Farhan、

正确、如果器件断电并且 PRE 和 CLR 未设置、则输出可能会最终处于未知状态。
最好使用电源正常将 CLR 拉至低电平、以便在掉电条件下、无论器件是否完全断电、器件的 Q 输出都将为低电平。

最棒的
Michael

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