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[参考译文] CD74HCT4046A:CD74HCT4046A

Guru**** 668880 points
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https://e2e.ti.com/support/logic-group/logic/f/logic-forum/687707/cd74hct4046a-cd74hct4046a

器件型号:CD74HCT4046A

您好!

我使用 CD74HCT4046的 PC2作为相位检测器、PC2Out 输出在 RC 滤波后驱动 VCXO。


         根据数据表、PC2OUT 是边沿触发式 JK 触发器输出。
当 Sigin 和 Compin 边沿分别相对先进和延迟时、正脉冲和负脉冲将输出、而其余状态保持不变。

         但是、在实际电路测试中、PC2Out 脉冲输出正常。 在高阻抗状态下、PC2Out 理论上应该保持不变、但实际结果是 PC2OUT 在高阻抗状态下下降至0电平、因此不能形成相位误差的累积。 最后、滤波后只能获得很小的电平、VCXO 通常不会驱动频率调整、从而在 GPS 信号上形成锁相。   

蓝色表示 PCPoout 波形、黄色表示 PC2out 波形

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    尊敬的 Eric:
    很抱歉、我们今天无法发表您的帖子-我们的应用团队在达拉斯 FAE 峰会上举办了多项活动、我们真的需要全力关注、以便为您提供一个好的答案。 我们一定会在明天回来的。
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    尊敬的 Eric:

    我能否获取另一个示波器截图、其中包括 SIGin 和 COMPin 以及两个输出? 它将帮助我查看器件的完整操作。
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    您好!Dylan、

    黄色为 PC2Out、蓝色为 PCPout、紫色为 Sigin、浅蓝色为 ComPin

      可以看出 PC2OUT 上升并保持正常、但当 PCPout 为零时、PC2OUT 迅速下降至0电平。

    理论上、RC 参数不应改变、上升时间和下降时间应相同、但上述波形中的下降时间显然比上升时间快。

    因此,PC2out 被减少到0 leve。 l 在每个 PPS 周期内、误差信号会形成周期性波动、不能累加。  

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    尊敬的 Eric:
    我们似乎在两个不同的位置处理这个线程。 为了防止浪费资源、我们可以将这两个线程组合在一起吗? 在结束之前、我只想与您核实一下、它们确实是讨论中的同一个问题。

    这是另一个线程: e2e.ti.com/.../689323
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    您好!

    您能帮我解决这个问题吗?

    此致、
    Eric
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    尊敬的 Eric:
    我正在努力解决这个问题--你是否阅读了我的最后一篇文章? 这两个问题是否相同?

    我相信您可以理解、在多个位置处理同一问题会显著降低速度。
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    您好!

    它们是相同的问题。
    它可能是客户自己在论坛上发布的版本。
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    谢谢 Eric、
    我在另一个主题中发布了几个关于如何跟踪此问题的想法。

    为了限制在这个问题上所做的双倍工作、我将锁定这个线程并将所有内容保留在另一个线程上。 请发布任何其他问题/意见等 位于以下主题中: e2e.ti.com/.../689323