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[参考译文] SN74AUP1G125：输入上升时间

admin
Guru**** 2380450 points
Other Parts Discussed in Thread: SN74AUP1G125
请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/logic-group/logic/f/logic-forum/731054/sn74aup1g125-input-rise-time

器件型号：SN74AUP1G125

您好！

 我们在设计中使用的是 SN74AUP1G125器件、查询与 OE 引脚上的输入上升时间限制有关。

我们使用基于 RC 的延迟电路来控制 SN74AUP1G125器件的 OE 引脚、上升时间为~33 μ s。 OE 引脚输入的上升时间是否正常或有任何限制。

数据表中显示"迟滞"且最长上升时间为200ns/V、您能澄清一下规格并提供更多详细信息吗

此致、

  • 0
    TI__Guru**** 2380450 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    您好、Johnson、

    数据表指出：

    输入迟滞可在输入端实现慢速输入转换和更好的开关噪声抗扰度


    您还注意到了200ns/V 的输入转换时间规格

    我猜您的困惑来自"慢速输入转换"的定义。  在这种情况下、"低输入转换"被定义为以200ns/V 转换的信号  任何较慢的电流、并且可能会振荡并损坏器件的电源电流。 "快速输入转换"将被视为小于5ns/V

    33us 的输入转换时间比器件额定运行速度慢大约100倍。

    这里有一个视频、介绍了如何使用标准 CMOS 输入安全地实现上电信号：