大家好、
您能在下面查询一下吗?
我们以前使用 FPGA 驱动固态继电器的输入、全部采用5V 逻辑。 FPGA 输出受到压摆率限制。 由于 DMS、但现在是3.3V 逻辑、需要替换 FPGA。 仍然与相同的固态继电器连接、因此需要3.3V 至5V 电平转换。 想要保持类似的压摆率限值。 遗憾的是、FPGA 未指定压摆率、仅指定慢速压摆率与快速压摆率的总传播延迟(差异约为2ns)。 我们正在寻找与 SN74LVTH244类似的器件。
提前感谢您。
此致、
Marvin 酒店
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我们以前使用 FPGA 驱动固态继电器的输入、全部采用5V 逻辑。 FPGA 输出受到压摆率限制。 由于 DMS、但现在是3.3V 逻辑、需要替换 FPGA。 仍然与相同的固态继电器连接、因此需要3.3V 至5V 电平转换。 想要保持类似的压摆率限值。 遗憾的是、FPGA 未指定压摆率、仅指定慢速压摆率与快速压摆率的总传播延迟(差异约为2ns)。 我们正在寻找与 SN74LVTH244类似的器件。
提前感谢您。
此致、
Marvin 酒店
尊敬的 Marvin:
大多数逻辑用于产生非常快的输出信号。 AUP 逻辑系列具有较慢的转换输出、有些客户使用这些输出来降低 EMI、但我们的产品系列中未指定压摆率或没有任何特定的压摆率受限逻辑门。
他们可以尝试使用驱动强度较低的逻辑系列-例如、HC 逻辑系列通常在5V 时具有大约30欧姆的输出、而 SN74LVTH244A 的 输出接近5欧姆。
我只建议挑选几个引脚对引脚选项并在他们的系统中尝试它们--所有'244功能将具有相同的引脚分配。 我无法直接链接到仅包含"244个函数的预筛选列表、但可以轻松转到下面的链接、在参数表顶部的筛选框中输入"244"。
https://www.ti.com/logic-voltage-translation/buffers-drivers-transceivers/noninverting/products.html
它们可以尝试按 I_OL 或 I_OH 进行排序、并查找驱动强度较小的器件以获得较慢的压摆率。