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[参考译文] CD4536B:如何生成占空比为70%的方波

Guru**** 663810 points
Other Parts Discussed in Thread: CD4536B, TPL5110, SN74HC112, SN74LVC1G97
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/logic-group/logic/f/logic-forum/1245485/cd4536b-how-to-generate-a-square-wave-with-duty-cycle-of-70

器件型号:CD4536B
主题中讨论的其他器件: TPL5110SN74HC112SN74LVC1G97

您好!

我正在尝试使用计时器 IC 生成一个持续时间为几秒、占空比约为70%(或30%、然后将其反相)的方波。

我想仅使用 HW、而不使用 MCU。

我发现实现这一点的最佳 IC 应该是 CD4536B、但通过研究数据表、我没有明白如何生成更大的脉冲宽度。

在此范围内、我是否可以使用任何其他 IC?

提前感谢您。

此致、

C.

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    75%是否合适? 如果有、请尝试使用 TPL5110生成脉冲、构建具有两个触发器(例如 SN74HC112)的两位计数器、然后使用与或门将输出仅在四种状态之一下处于活动状态。 (或者、也可以使用四位移位寄存器的一个输出、这将需要四个具有独立置位/复位输入的 D 触发器来初始化它们。)

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    TPL5110是一个不错的选择。  

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    大家好、感谢大家的帮助。

    很抱歉我迟到了重播,我当时正在考虑这个解决方案。

    我的怀疑是触发器的传播延迟、它会导致和输出在第二个 FF 输出的高半周期结束时上升几百 ns

    CLK   __________ ----____ ----____ ----____ ----____ --__

    第1季度   _______ ---------------- _________________ - ---------------- _________________ ----------------

    Q2   __________ ------------------------------------------------------- - ___________________ --------

    和_______ ---------------- _________________ - ___________________ --------

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    通过 JK 触发器、您可以构建同步计数器。

    在5V 时、SN74HC112的传播延迟约为15ns;同一芯片上两个触发器的抖动要小得多、通常小于1ns。 该时间小于输出的上升/下降时间。

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    很抱歉、我无法一一一一列举。

    对于 3.3V 的触发器、传播延迟高达100-200ns。

    而对于与门、典型传播延迟最长为5ns。

    这意味着、当 Q1在 Q2高半周期结束时上升时、可能会有大约200ns 的时间、其中 Q1和 Q2都为高电平、因此和输出也为高电平。

    您认为这里的错误在哪里?

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    那么您打算使用3.3V 电源吗?

    在同步计数器中、触发器会同时切换。

    如果您要减慢与门的速度、请使用具有施密特触发输入的栅极(例如、SN74LVC1G97)并在其输入端添加 R-C 滤波器。

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    是的、我有3.3V 电源。

    在该配置中、两个 FF 不会同时切换、因为第一个 FF 的输出用作第二个 FF 的时钟输入。 因此、两个输出之间存在传播延迟。

    我曾考虑使用具有施密特触发输入的与、但没有找到具有此类输入迟滞时间的运算放大器。

    也许 RC 滤波器是唯一的方法、我当时想它。

    谢谢!

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    在同步计数器中、FFs 使用相同的时钟:

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    "对不起,我也没想到会被你撞见的。"

    谢谢你,克莱门斯