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[参考译文] SN74LV164A:逻辑论坛

Guru**** 2378650 points
Other Parts Discussed in Thread: SN74AHC244
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https://e2e.ti.com/support/logic-group/logic/f/logic-forum/1287104/sn74lv164a-logic-forum

器件型号:SN74LV164A
主题中讨论的其他器件:SN74AHC244

您好、TI 团队

请参阅随附的功能方框图、我们使用了两个 TI 逻辑 IC、一个是八路缓冲器、一个是移位器逻辑 IC。

目前是输入时钟波形的 U349 PIN2、它在上升沿进行过冲、但是  U349输出时钟波形都在 上升沿进行过冲。

我们尝试将串联电阻(R5321至 R5328)调整为33欧姆、看起来过冲没有明显改变、我们需要调整串联电阻(R5321至 R5328)到127欧姆、过冲将 明显改变、请参考所附的波形。

我的问题是:

1.为什么 U349 (八路缓冲器)输入时钟波形没有过冲在上升沿、但 U349输出时钟波形都有过冲在 上升沿?

2.看起来 串联电阻(R5321至 R5328)更改为127欧姆、过冲会 明显发生变化、我们如何确保串联电阻(R5321至 R5328)的值合理?

U349缓冲器输出连接到 U352 (TI 移位器逻辑 IC SN74LV164APWR)、移位器逻辑 IC VIH/VIL 都符合规格、但是时钟波形在上升沿过冲、可以接受吗?

 

谢谢

杰瑞

e2e.ti.com/.../244-buffer-with-shifter-logic_5F00_TI.pdf

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    1.LVC 输出具有非常高的驱动强度、因此如果迹线足够长并且未正确端接、确实会发生振铃。 添加一个源端接电阻器会很有用;另一种减少缓冲器输出阻抗与布线特征阻抗之间失配的方法是使用驱动强度较低的缓冲器、如 SN74AHC244‍PWR。

    2.典型的布线阻抗靠近50 Ω,因此可以使用33 Ω 源端接电阻。 我怀疑您在33 Ω 中看到的振铃不在迹线本身中、而是由示波器探针的接地线夹形成的谐振电路引起的。 考虑改用接地弹簧;请参阅 《针对噪声、开关和高频信号进行精确的示波器测量 》演示。

    3.如果振铃只是测量误差,不会有什么坏处。 不超过7V 绝对最大额定值的实际过冲并不是真正的问题、但是如果它返回到低于 VIH (或高于 VIL 以在下降沿后进行振铃)、振铃会成为一个问题。

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    您好、TI 团队

    我把波形作为连接点。

    因此、对于  U352 (TI 移位器逻辑 IC SN74LV164APWR)、我们只需要通过以下方式进行检查:

    1.输入 CLK 和 CLR 信号过冲/下冲不超过7V (请提供证明文件)

    2.输入 CLK 和 CLR 信号 振  铃不低于 VIH、且振铃不高于 VIL

    请帮助确认这些。

    谢谢

    杰瑞

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    是的。

    这些波形是可以的。

    (您尚未指明测量方法。 如果您使用接地线夹、则实际的波形会更好。)

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    您好、TI 团队

    感谢您的确认。

    您是否有任何文档可以解决过冲无法超过7V 的问题?

    谢谢

    杰瑞

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    您好、TI 团队

    我们将 串联电阻(R5321至 R5328)更改为127欧姆、因为过冲将明显降低、

    您是否担心 在使用 U352 (TI 转换器逻辑 IC SN74LV164APWR)时串联电阻(R5321至 R5328)更改为127 Ω?

    谢谢

    杰瑞

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    数据表第6.1节规定了绝对最大额定值。

    增加连接到127 Ω 的串联电阻器没有问题;您的波形显示信号仍然正常。