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[参考译文] SN74LVC8T245-Q1:SN74LVC8T245转换方向交换的条件?

Guru**** 1101210 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/logic-group/logic/f/logic-forum/1311034/sn74lvc8t245-q1-sn74lvc8t245-conditions-that-translation-direction-swaps

器件型号:SN74LVC8T245-Q1

您好!

您是否知道电源噪声或欠压条件等任何会导致错误地在 schem 下面给出的指示从 B->A 切换到 A->B 的情况?

当然、去耦电容器放在靠近器件的位置、并且使用了实心接地覆铜。


最佳

迪米特里

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    尊敬的 Dimitri:

    是的、噪声或烧毁问题可能导致 OE 或 DIR 上发生方向变化的故障情况、例如、DIR 上的 VCC 短路可能导致 方向错误地从 B->A 切换到 A->B。 此外 、 慢速/浮点输入或高噪声输入 也可能导致 DIR 在  A->B 时拾取高电平而不是低电平。

    您可以进一步确认是否存在任何损坏、例如问题是否与所有其他装置/仅一个装置一致、或是否与系统环境相关、谢谢。

    此致、

    迈克尔.

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    谢谢 Michael。



    在这种情况下、OE 和 DIR 都通过铜短接至 GND、因此如果它们悬空我会感到惊讶。



    [quote userid="520401" url="~/support/logic-group/logic/f/logic-forum/1311034/sn74lvc8t245-q1-sn74lvc8t245-conditions-that-translation-direction-swaps/4981267 #4981267(1999)此外,  缓慢/浮动输入或有噪声的输入 也可能导致 DIR 对  A->B 选择高电平而不是低电平。

    那么对于慢速输入、什么机制会导致 DIR 拾取高电平? 我认为快速/剧烈瞬变可与 DIR 耦合。

    您可以针对这种情况建议任何缓解措施吗? 例如 RC 滤波器、每个引脚上的10k 下拉电阻、100pF/220pF 等小电容接地? PWM 频率仅为500Hz、因此性能没有任何问题。

    最佳

    迪米特里

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    尊敬的 Dimitri:

    对于慢速输入,什么机制会导致 DIR 拾起高电平? 我认为快速/剧烈的瞬变可以与 DIR 耦合。

    请帮助参阅 [FAQ]慢速或浮点输入如何影响 CMOS 器件? 为了帮助确认低电平的预期波形是否也观察到高电平振荡的相似性、即您是否观察到1/2 Vcc 左右的噪声?

    、您可以为该案例推荐任何缓解措施吗? 例如 RC 滤波器、每个引脚上的10k 下拉电阻、100pF/220pF 等小电容接地? PWM 频率仅为500Hz,因此不存在任何连接问题。
    • 建议确保5V 输入的速率高于5ns/V。
    • 移除滤波器、因为它们也会减慢转换速度。 如果悬空、则可以使用下拉。
    • 根据噪声级别对电源使用去耦、也就是说如果仍然有噪声、则使用更多的去耦。

    如果需要具体建议、请进一步帮助阐明具体问题所在的情况、即噪音、缓慢/悬空输入、短路或损坏等、谢谢。

    此致、

    迈克尔.

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。
    请参阅 [FAQ]慢速或浮点输入如何影响 CMOS 设备? 为了帮助确认低电平的预期波形是否也观察到高电平振荡的相似性、即您是否观察到1/2 Vcc 左右的噪声?

    我看到了这个概念,可以用施密特触发器解决

    感谢您的帮助、如果我收到更多信息、我会再提出任何问题