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[参考译文] MSP430F5659：切换数字输出 P6.6时、引脚 P7.6上的 DAC0出现毛刺脉冲

admin
Guru**** 2538950 points


请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/microcontrollers/msp-low-power-microcontrollers-group/msp430/f/msp-low-power-microcontroller-forum/647668/msp430f5659-glitch-at-dac0-on-pin-p7-6-when-togling-digital-output-p6-6

器件型号：MSP430F5659

我已将 DAC0配置为 P7.6、输出为400mV。

P6.6 (也可被配置为 DAC0) 被配置为数字输出、而不是 DAC0。

当 P6.6上升时、我看到 DAC0下降大约15us。

有没有解决方案？ 谢谢你。

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    TI__Guru**** 2538950 points
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    DAC 设置为80mV、而不是400mV。 它会立即下降至0V、持续10us。 然后、它会上升7~8 μ s、回到80mV。
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    TI__Guru**** 2538950 points
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    您好 Gabriel、

    我将检查您的问题并尽快答复您。
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    增大 DAC 输入缓冲器的电流没有任何帮助。 增大输出缓冲器的电流有助于缩短毛刺脉冲持续时间、但不能减小其振幅。

    谢谢你。

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    尚无新闻？

    此致、

    Gabriel

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    您好 Gabriel、

    作为完整性检查、请确认 DAC12OPS 位已置位且 DAC12AMPx 大于1 (根据您12/6的回复、我对此非常有信心)。 另外、请尝试通过相应地设置 PxDS 寄存器位来更改输出驱动强度。 我将询问设计团队、PAD 逻辑是否可能导致此问题、但由于假日季、响应将会延迟。

    此致、
    Ryan
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    您好、Ryan、

    DAC12OPS 被置位。

    DAC12AMPx 是我之前更改的内容。

    现在、我尝试仅在 P6.6上设置 PxDS、仅在 P7.6上设置 PxDS、并在两者上设置 PxDS。  在任何情况下都没有帮助。

    我不确定"焊盘逻辑"是什么意思。

    谢谢、

    Gabriel

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    您好 Gabriel、

    此致、Ryan

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    明白了。 如果您有更多信息、请告诉我。

    Gabriel

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    我已经重复过这种行为、并且正在与质量团队讨论这种行为、与此同时、您是否考虑使用电容器来缓解这一问题？

    此致、
    Ryan
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    我实际上已经有一个100pF 的电容器。 我  没有评估没有电容器 或更大电容器时的行为。 增加电容器可能会增加稳定时间。 我需要它小于~50us。

    您可以建议一个有助于实现的电容器值吗？

    谢谢、

    Gabriel

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    TI__Guru**** 2538950 points
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    使用1至10nF 的电容重新评估。

    此致、
    Ryan
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    我添加了10nF、它对尖峰振幅没有帮助。 实际上、它使它变得更糟、因为它在尖峰之后增加了一些振荡、从而使稳定时间增加了10us 以上。
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    TI__Guru**** 2538950 points
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    该值可能太小、是否可以使用1uF 重试？

    Ryan
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    Gabriel、Ryan、

    我们检查了您的行为并研究了设计。 详细的技术设计分析确定了两个 DAC0输出反馈路径之间可能的电容耦合路径、这可能会解释一个 DAC0输出上的动态干扰、而另一个 DAC0输出作为 GPIO 运行并进行切换。
    此动态行为未指定、且从未表征。 调查还考虑了解决此行为的可能方法。 但是、由于架构和客户的时序要求(稳定时间为50us)、最好的方法是使用不同的 GPIO。
    我还尝试了1nF 和100nF、这改变了波形、使 DIP 更少、但在 GPIO 转换期间会产生虚构的影响。

    希望您的应用允许使用不同的 GPIO。
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    TI__Guru**** 2538950 points
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    感谢 Ryan 和 Dietmar 确认这一点。

    我们 将为 我们的应用程序制定最佳的解决方法。