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[参考译文] MSP430FR6007:勘误表 CS12

Guru**** 608155 points
Other Parts Discussed in Thread: MSP430FR6007
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/microcontrollers/msp-low-power-microcontrollers-group/msp430/f/msp-low-power-microcontroller-forum/1185561/msp430fr6007-errata-cs12

器件型号:MSP430FR6007

我目前正在调查 SLAZ733B ("勘误表 MSP430FR6007微控制器")中的勘误表编号 CS12、对此我有几个问题。
该文件指出:
'当改变频率(CSCTL1.DCOFSEL)时、DCO 频率可能会过冲
并超出数据表规格。 经过10us 的一段时间后
频率过冲稳定至数据表中指定的预期范围。
切换到或切换任何 DCOFSEL 设置时会发生过冲、并影响所有设置
使用 DCO 作为时钟源的外设。 也可以在上看到潜在的影响
FRAM 访问、因为过冲可能会导致临时违反 FRAM 访问
和周期时间要求。"

过冲幅度是否遵循 DCOFSEL-值-因此 DCOFSEL 值为0 (DCORSEL = 0)是否始终比 DCOFSEL 值为6 (DCORSEL = 1)提供更低的过冲?

是否可以预测过冲的大小(最坏的情况)? FX。 如果 CTL1设置为0x000A (DCOFSEL = 5/DCORSEL = 0)(CTL3为0x0000)、那么实际频率开关从8MHz (默认值)切换到7MHz 会怎么样-这是安全转换吗?

在使用 DCO 作为时钟源的外设上、最坏的情况会影响什么-任何会导致微控制器冻结/重新启动的情况?
或者、是否仅临时违反了 FRAM 访问和周期时间要求、才会导致微处理器重新启动?

  • 请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

    您好、Bue、

    您是否在中应用中切换时钟速度? 或者是否有任何限制您无法实施该变通办法?

    没有一种方法可以保证它将"过冲"的量;解决方法是在10us 后为安全网使用1/4分频器、从而恢复正确的分频器。 我还建议在您更改 DCO 频率后等待10us、因为这种影响可能不一致。我不希望器件重新启动或冻结、但如果访问了不正确的存储器、则可能会出现这种情况。 对于由 DCO 供源的外设、它将具有不正确的时序、这可能会导致任何外设中的错误。 (ADC 采样、通信问题等)

    此致、

    Luke

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    你好、Luke。
    非常感谢您的回答。
    在我们的当前实施中、我们仅在初始设置期间切换 DCO 时钟速度。
    这里、我们从8MHz (默认值)切换到7MHz -时钟切换后、CTL3中的所有3个分频器立即设置为0 (/1)。
    之后、我们在 DCO 和 HFXTCLK 之间来回切换、作为 MCLK 和 SMCLK 的时钟源(两个时钟始终同时切换、并且具有相同的时钟源)、但我们不会改变 DCO 时钟速度-这是否会有问题?
    如果我们可以避免、我们当然不希望在初始设置期间引入 μ 10µs 延迟。
    我们的看门狗正在 VLOCLK 上运行、因此 我假设在冻结或存储器访问不正确的情况下、它仍然能够正确地重置我们的器件-这是正确的吗?

    在 TI 进行调查时、您在哪些条件下观察到了此问题。
    是在将 DCO 频率从较低频率切换到较高频率时、还是在从较高频率切换到较低频率时?
    是在将大频率阶跃(如8MHz 至24MHz (或24MHz 至8MHz))切换或同时执行7MHz 至8MHz (或8MHz 至7MHz)等小频率阶跃时。

    我希望这是提出上述问题的正确地方、否则请随时告诉我应该向他们提出哪些问题。

    此致

    BUE

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    您好、Bue、

    从8MHz 到7MHz 不会看到明显的过冲、但我仍然建议使用权变措施或变体。 频率可能约为过冲/下冲的~25%、因此您会看到更大的过冲会达到24MHz 与7MHz。 10us 等待是所有情况下的安全网、如果您喜欢这种方法、您可以根据自己的具体需求进行调整。

    在切换 CLK 时、您是否考虑了以前从这些源获取的任何外设? 具体来说、如果您在更改 CLK 源频率时未正确更新其寄存器以考虑新的 CLK 频率、UART 或 ADC 等器件可能会导致意外结果。 在外部晶体和 DCO 之间更改源的目的是什么?  

    看门狗将正常运行。

    此致、

    Luke

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    你好、Luke。
    再次感谢您的回答。
    您写道:

    "从8MHz 到7MHz 不会看到明显的过冲、但我仍然建议使用权变措施或变体。 频率可能约为过冲/下冲的~25%、因此您会看到更大的过冲会达到24MHz 与7MHz。"

    只需阐明:

    1) 1)当您使用前一句中的"频率"一词时、您意味着增量值-因此8MHz 至7MHz = 1MHz 或您所指的频率是什么?
    2) 2)以下是什么意思"频率可以大约为过冲/下冲的~25%"。 这是否意味着过冲将比问题1中的频率大4倍?
    3) 3)当从8MHz 到7MHz 时、过冲将始终以负方向发生-因此7MHz -(1MHz x 4)= 3MHz、以便转换阶段的频率将在8MHz 到3MHz 范围内、还是可以为正?
    4)从我之前的帖子中:在从 DCO 切换到 HFXTCLK 以及从 HFXTCLK 切换到 DCO 时、它是否会产生频率过冲- DCO 频率不会改变?

    我们在外部晶体和 DCO 之间更改源的原因是为了在有限的持续时间内获得更稳定的时钟。 我们随后再次切换回以节省电量。
    对于 UART 和 ADC、我们在切换 CLK 源时将其寄存器设置为适合新的 CLK 频率。

    此致

    BUE

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    您好、Bue、

    1. 频率是稳定前的 DCO 频率、它始终朝向目标、因此从8MHz - 7MHz 开始、您将在稳定前看到最坏的5.25MHz 初始频率。 (7MHz -(7/4))。 如果从8MHz 到>16MHz、则最坏情况在稳定至16MHz 之前为20MHz、这违反了运行条件、因此趋稳 更为关键。
    2. 频率升高时的过冲为+25%、频率降低时的过冲为-25%。 25%基于您的目标频率。
    3. 如果从8MHz 到7MHz、DCO 稳定前的范围将为7MHz - 5.25MHz
    4. 您不会看到 DCO 到 HFXTCLK 的过冲、反之亦然。 仅当 DCO 频率发生变化时。

    我认为、对于您的应用、您不会从该勘误表中看到明显的影响、但我仍然建议稳定 DCO 频率、以便您的外设时序准确。 如果您在开始时设置 DCO 频率一次、然后将其保持在7MHz、则应该不会对您的应用产生进一步的影响。

    此致、

    Luke