[参考译文] XEVMK2LX：支持的最大 ADC 数据速率

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Other Parts Discussed in Thread: RFSDK, DAC38J84, ADC14X250

请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/processors-group/processors/f/processors-forum/719512/xevmk2lx-maximum-supported-adc-data-rate

器件型号：XEVMK2LX
主题中讨论的其他器件：RFSDK、 DAC38J84、 ADC14X250

你好、Joe

感谢快速响应。我注意到、使用 DFE 将限制吞吐量。在我们的应用中、我们不一定需要 DFE 功能。我们希望将原始数据尽快放入 DSP (存储器中的乒乓缓冲器中)。我们需要时间同步双 ADC 配置(类似于 IQ 接收器)。

可与66AK2L06 EVM 搭配使用的最大双通道 ADC 采样率(12-14位分辨率)是多少。根据提供的信息、我们应该能够在第一个 FMC 连接器上使用所有4个 Rx JESD 通道、并在双通道配置中为每个 ADC 通道获取737.28Msps。是这样吗？ IQN2上是否存在可防止这种情况的后续速度限制？

我们还需要系统中的 DAC 由 66AK2L06 EVM 进行驱动。识别的 DAC 为 DAC37J82。 DAC EVM 是否可以通过其他 FMC 连接器进行驱动、或者我们是否需要确定性延迟卡来更好地同步 DAC 和 ADC？

谢谢你

5 年多前

0 admin 5 年多前

TI__Guru**** 1284310 points

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您好！
Serdes、DFE Rx、DFE 基带、IQN2基带接口在多个地方都有限制。
接收链或发送链没有宽带旁路。

接收 JESD 通道可支持4条7.3728Gbps 速率的通道、但 Rx 数据必须进入 JESD 块和 DFE。 DFE 有一个 Rx 端口、其输入以 DFE 时钟速率、245.76e6/n 或368.64e6/n 运行

由于这是32位宽、因此您可以(1)以368.64e6的速率传输2个实数样本的 ADC、采样率为737.28e6 (不在 RFSDK 中)
737.28e6 Real ->转换为368.64 Complex、并且必须在 Rx 184.32e6中将其抽取2、并在 DDUC 中将122.88e6 BB 输出抽取3/2。

您可以查看 TI 参考设计和 DFE 用户指南" www.ti.com/.../spruhx8a.pdf "以了解更多信息

您可以具有(1) 368.64e6复数输入。
Rx 模块抽取2至184.32e6。
对于122.88e6 BBoutput、DDUC 抽取率为3/2。
在 DDUC 中、一个数据流可转换为2个通道、并具有2倍的抽取率、从而实现92.16e6 BB 输出。

您可以有(2) 184.32e6个复数输入、通常在本例中、Rx 或 DFE 块抽取2。
2个通道将具有92.16e6 BB 的输出速率。

Tx 侧和 Rx 侧通常具有相同的 BB 通道速率
1个通道-> 1个流-> 1个通道122.88e6
2个通道-> 1个通道/流(总共2个流)-> 2个通道92.16e6

TIDEP-0060使用 RFSDK、1根天线、1通道、DAC38J84、ADC14x250
TIDEP-0081使用 RFSDK、2个流、2个通道、DAC38J84、ADC32RF8x

注意：数据通信器的编程在 RFSDK 启动序列之前完成。
如果您希望使用其他数据转换器、则需要采用相同的 JESD 格式、或联系第三方提供商
对于定制工作、Azcom Ltd、CommAgility Ltd.

此致、
Joe Quintal

0 admin 5 年多前

TI__Guru**** 1284310 points

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感谢您提供更多信息。 Rx 数据吞吐量限制现已清除。

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