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[参考译文] WEBENCH®︎工具/TLV62065-Q1：TLV62065-Q1 PSpice 瞬态模型仿真输出异常

admin
Guru**** 1681120 points
请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/tools/simulation-hardware-system-design-tools-group/sim-hw-system-design/f/simulation-hardware-system-design-tools-forum/932513/webench-tools-tlv62065-q1-tlv62065-q1-pspice-transient-model-simulation-output-anomaly

器件型号：TLV62065-Q1

工具/软件：WEBENCHRegistered设计工具

您好：

使用官方网站 pspice model-SLIM249B.ZIP (110KB)- PSpice 模型

 仿真条件：

仿真1：更改 R10和 R11、所有其他参数保持不变、启动仿真、VOUT 不是1.1V、

问题1：为什么 VOUT 为1.8V？

仿真2：更改 Iload、所有其他参数保持不变、启动仿真、VOUT 波形异常。

问题1：为什么 VOUT 波形异常？

谢谢

  • 0
    TI__Guru**** 1681120 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

    您好、Huan、

    用于仿真1。 该项目包含两个测试基准。

    启动  

    2.稳定。

    您已在稳定的测试台进行了更改、但运行了启动测试 台的仿真配置文件、因此显示了启动测试台的结果。

    请使用"make Root"选项将稳定测试台设置为 root、并激活如下所示的稳定测试仿真配置文件。

    结果 如下所示。  

    对于仿真2、请按如下所示配置脉冲源和仿真配置文件。

    谢谢、此致、

    Praveen