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[参考译文] PMP22075:当输入电压低于大约10.75V 时、无法获得完整的12V 输出

Guru**** 665180 points
Other Parts Discussed in Thread: PMP22075, LM5026
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/tools/simulation-hardware-system-design-tools-group/sim-hw-system-design/f/simulation-hardware-system-design-tools-forum/1225811/pmp22075-i-cannot-get-the-full-12v-output-when-the-input-voltage-is-less-than-10-75v-approx

器件型号:PMP22075
主题中讨论的其他器件: LM5026

大家好、德州团队。

我已经使用提供的光绘文件等构建了 PMP22075。

此设计的输入电压范围为9V 至60V。  

我的问题 但是当我降低输入电压时,一旦输入电压低于大约10.75V ,输出就开始从标称12V 下降。

迄今为止的调查-占空比-  正如预期的那样、我可以看到 LM5026的 OUT_A 的占空比随着输入电压的降低而增大。

但当输入电压大约等于10.75V 时、占空比会达到约73%的限值

  • 在 DCL 直接连接到 LM5026上的 RT 的情况下、我们应该会对最大占空比进行编程。
  • 占空比和 UVLO 电压之间也存在关系-如 LM5026数据表的图11和图18所示。
    • UVLO 电压由 R10、R13和 R17组成的电阻分压器设置。
    • 当输入电压= 9V (9V x 10.5 /(10.5 + 53.6 + 1))时、输出电压似乎为1.45V
    • 如果 UVLO 为1.45V、那么我们预计最大占空比低于80%? -如图11和18所示。

  •       

我的问题 : 请告知当输入电压处于此范围的低端(例如从9V 到10.5V)时,如何才能实现完全12V 的输出?

(我们的应用要求最小输入电压为10.5V)。

提前感谢。

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    您好、Fraser、您是否尝试过在较低输出功率下测试较低的输入电压? 例如、您可以在半负载或轻负载下尝试此方法吗? 它可能在较低的输入电压下达到其电流限值。 如果是这种情况、您可以略减小检测电阻。 谢谢!

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    您好、Darwin。

    感谢您的建议。 但我在较低的 O/p 负载(0.6A、1.2A 和2.4A)上遇到了同样的问题。

    我最近的发现 -我发现了一个类似的参考设计, PMP7892,它有一个20k 电阻连接到 LM5026的时间引脚。 PMP22075设计有一个143k 电阻器 R16连接到时间引脚。

    当我将 R16从143k 更改为20k 时、PWM 重叠持续时间从400ns 减少到60ns。

    我现在可以将输入电压降至大约9.7V、而不会降低输出电压12V。  

    PWM 重叠时间(主 SW FET 和钳位 FET)的大小与可以实现的最大占空比之间似乎存在关系?

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    大家好、Fraser、在这个频率下进行有源钳位设计时、通常从  50ns-100ns 的重叠开始。 400ns 似乎相当大、数据表只表中描述了高达110k 欧姆的 RSET。 通常、可以将其设置为 开关周期的2-3%。 通过查看测试报告、您会发现周期 为~6us、即~120ns。

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    感谢您的帮助、Darwin。