主题中讨论的其他部件: TS5A2053, HD3SS3411, TS3A5223
您好,
在我的PCIe Gen5主机设计上,我需要支持PCIe_REF_CLK (连接器引脚A13/A14)作为SoC的输入或输出。 SoC引脚是双向的。
时钟应支持带或不带SSC。
请问TS3A5018是否适合我?
感谢高级
艾雷兹。
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您好,
在我的PCIe Gen5主机设计上,我需要支持PCIe_REF_CLK (连接器引脚A13/A14)作为SoC的输入或输出。 SoC引脚是双向的。
时钟应支持带或不带SSC。
请问TS3A5018是否适合我?
感谢高级
艾雷兹。
嗨,Erez,
您能否提供更多信息,说明您实际执行的是哪几行mutxing? 是否仅为参考clk? 这是标准的100MHz参考吗?
只要您处于或低于数据表中列出的推荐电压(3.3V)和带宽(300MHz),就应该可以使用TS3A5018。 也就是说,如果您只需要一条线路,那么在空间和成本方面,只有1个通道而不是4个通道的设备可能会更好? 1 信道2:1 (如TS5A2053)可以工作
谢谢!
Rami
您好Rami:
感谢您的快速重播!
我要为Gen5交换机多路配置PCIe REF_CLK_N/P 100MHz SSC。
首先,我考虑使用 HD3SS3411。 我被告知它不支持SSC
在我的应用程序中,PCIe插槽可以填充端点(蓝色)或RootComplex (红色) , 并且REF_CLK信号分别为输入或输出。 请参阅下表。
我的问题是抖动。您的设备添加了什么抖动(如果有)? 您是否有使用PCIe Gen 5时钟多路复用器的经验? 我的申请是否应考虑其他因素?
嗨,Erez,
我们的模拟多路复用器只是无源器件,可以被视为仅仅是一个RC电路。 RC为接通电阻和接通电容。 这可用于近似的设备特性,如BW,传播延迟和抖动。 抖动是传播延迟的变化。 通常,这不是大多数交换机的问题。 电容在不同的用例中将保持相当一致,但是RON会因RON平面度而异,对于差分信号,另一个关注点可能是增量RON (开关之间ON状态电阻的差值)。 这些规格的变化越小,抖动越少。 因此,像TS3A5223这样的设备可以很好地将抖动降至最低。
话虽如此,我不是PCIe信号专家,因此我不能在此向您提供任何保证。 如果你能给我更多的信息,我就能更有信心地回答我的问题。 根据HD3SS3411和TS3A5018的选择,电压似乎=<3.3V。 您可以确认吗?
更重要的是,为什么说HD3SS3411不能用于SSC信号? 是否特别有规范? 这不是我们在模拟开关和多路复用器产品组合中的设备之一,但我浏览了E2E,发现这篇文章表明该设备适合SSC时钟:
谢谢!
Rami
感谢Rami的详细回答。
有关PCIe GEN.5要求,请参阅随附的规范。
关于 HD3SS3411,这是我在E2E上得到的答案: https://e2e.ti.com/support/interface-group/interface/f/interface-forum/109.5092万/hd3ss3411-pcie-ref-clk-mux-demux/4055676#4055676</s>3411 405.5676万405.5676万
您是否可以根据您推荐的解决方案建议添加抖动?
谢谢!
艾雷兹
嗨,Erez,
从这条线来看,我不认为大家一致认为HDS不会起作用,而是不确定它是否起作用。 我仍然没有看到任何迹象表明存在问题,但正如我所提到的,我在PCIe或更具体地说SSC方面没有太多经验。 似乎只是一个调制频率信号;因此是一个使用调制频率编码的载波信号。 底线似乎只是一个模拟信号,因此不应受到这些无源设备的太大影响。
因此,我们通常不会指定抖动,因为我们的设备实际上不会增加太多抖动。 话虽如此,我们可以看看传播延迟,在这里了解我们可以期望的范围。 我们有一个很好的常见问题解答: [FAQ]如何在模拟开关/多路复用器中估计传播延迟和信道偏移?
传播延迟的变化,这实际上是抖动,会受到增量RON的影响。 通过查看增量RON,我们可以大致了解RC将如何变化。 因此,如果我们以TS3A5018为例,接通电容将保持在16pF,而Ron的最大变化为1欧姆。 所以1RC时间常数会给我们16ps的变化(或抖动)。 鉴于这只是一个近似值,它仍是高于此处允许的150马力的数量级。 只需记住,抖动和推力延迟在很大程度上取决于多路复用之外的负载本身。 因此,建议尽量减少负载并使轨迹长度保持较短,以帮助减少抖动。
谢谢!
Rami