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[参考译文] WEBENCH®︎工具/SN74TVC16222A:SN74TVC16222A

Guru**** 2378650 points
Other Parts Discussed in Thread: SN74TVC16222A
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/switches-multiplexers-group/switches-multiplexers/f/switches-multiplexers-forum/890416/webench-tools-sn74tvc16222a-sn74tvc16222a

器件型号:SN74TVC16222A

工具/软件:WEBENCHRegistered设计工具

您好 TI  

我对 SN74TVC16222A 应用有一些问题。

我的测试环境是我参考测量电路的3V3、1V8之间的电平转换。  

B 侧150欧姆 电阻是平均上拉 电阻功能? 为什么需要该 电阻?  

该 电阻值可能会发生变化? 对于外部:1K、2K  

如果移除此 电阻、是否仍正常工作?  

请回答我的问题。

谢谢  

Ken

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    您好 Ken、

    此图是一个示例应用、您不必完全按照所示的原理图进行操作。  

    这些电阻器可能会限制导通晶体管电流(建议的工作条件规格典型值为20mA、最大值为64mA)。

    您的应用可能不需要电阻器。 您可以根据需要设计电阻器和其他系统组件、以将电流和电压保持在建议的工作条件内。

    此致、
    Kate

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    尊敬的 Kate

    谢谢您的回复。

    您是否可以建议我们使用 SN74TVC16222A 的电路

    我的应用是需要从3V3到1V8 (B 侧到 A 侧)的电平位移数字信号(数据和 CLK)。 我们已经创建了使用 SN74TVC16222A 芯片的子板。 但 CLK 信号有时不稳定且奇怪。

    左侧正常、右侧为 NG (CLK 高电平消失)

       

    这是输出电平位移电路。  

    您能帮我们检查设计问题吗?

    谢谢  

    Ken

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    您好 Ken、

    感谢您发送波形和原理图。

    您可以提供有关波形的更多说明吗?

    • 这些示波器快照中的每个引脚都测量什么?
    • 您能否标记每次拍摄的电压电平?
    • 如果这是数字信号、则信号中的下冲是多少?
    • VCCO_J1处的电压是多少?

    谢谢!
    Kate

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    你(们)好 Kate

    这些示波器快照中的每个引脚都测量什么?

    =>该环境适用于 FPGA 平台。 源端是数字 I/O 播放卡中的数字数据(D0 ~ D11和 CLK)。  

    您能否标记每次拍摄的电压电平?

    => CLK 引脚电平= 6V、(峰间电平= 7.5V)。 数据引脚电平= 4~5V

    如果这是数字信号、则信号中的下冲是多少?

    =>来自源端的是 CLK 信号(数字 I/O 播放卡)。  

     

    VCCO_J1处的电压是多少?

    => VCCO_J1是 FPGA 电源1.8V 电源。  

    谢谢

    Ken

    谢谢您的回复。

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    您好 Ken、

    感谢您提供更多信息。

    为了澄清这一点、示波器快照是 CLK 信号路径的、峰间值为7.5V? 这是您遇到问题的唯一渠道吗?

    建议的最大输入/输出电压工作条件为5.5V。 不保证功能运行超出推荐的运行技术规格。 这可能是信号未按预期通过的原因。

    此致、
    Kate

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    你(们)好 Kate

    谢谢您的回复。

    我同意输入电平超出规格。 我们对信号发生器输出执行许多测试。  

    我们发现信号发生器的过冲问题。  

    我将尝试在  信号发生器输出端添加一些阻尼电阻和电容器。

    谢谢

    Ken