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[参考译文] TS3L501E：掉电模式行为

admin
Guru**** 1755960 points
Other Parts Discussed in Thread: TS3L501E
请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/switches-multiplexers-group/switches-multiplexers/f/switches-multiplexers-forum/574011/ts3l501e-behavior-of-power-down-mode

器件型号：TS3L501E

你(们)好

TS3L501E 支持断电模式、当 VCC=0V 时、它能够提供0至3.6V 的输入电压。

此输入是否意味着仅控制输入(PD 和 SEL)？

如果我们设置断电模式、是否应该关闭任何数据输入(A0-A7、B0-B7、C0-C7和 LEDx)？

贝斯特雷加兹

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    TI__Guru**** 1755960 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    NA Na、

    您可能已经确定了数据表错误。 当您将 PD 引脚设为高电平时、I/O 路径(A0-A7、B0-B7、C0-C7和 LEDx)将处于高阻态。 我们应该在数据表中提供器件处于高阻态时的泄漏电流规格。 通常、对于这些类型的开关、当高阻抗小于2uA 时的泄漏电流、因此在 PD 引脚处于高电平时、信号路径上的电压不会出现问题。 我将向设计团队提交申请、以确认并更正数据表。

    谢谢、
    Adam
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    TI__Guru**** 1755960 points
    请注意，本文内容源自机器翻译，可能存在语法或其它翻译错误，仅供参考。如需获取准确内容，请参阅链接中的英语原文或自行翻译。
    NA Na、

    我在实验室中测试了一个器件、发现信号路径上的 Vdd=0V 和3V 时、开关漏电流< uA。

    我们将采取措施进一步探索设计、并根据业务案例进行数据表更新。

    谢谢、
    Adam