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CDCE62005: 按照参考电路设计制板,芯片【供电电流过大】,且相对于电源电压有压降

Part Number: CDCE62005

我按照芯片手册里的参考电路绘制了电源:

             

图中的4个电感我依照型号使用了1000ohm的贴片电感;电源由外部台式稳压电源提供3.3V直流电;

但出现问题:

  • 此时外部电源供电电流达500mA,CDCE62005发热严重,且实际电压只有3.17V,这种压降是为什么?电流过大又是为什么?(经测量电容没有损坏)

期盼您的指点!

  • 您好,

    关于原理图:

    我看datasheet 中 30脚是接1kΩ电阻,建议您按照datasheet中的要求来:

    看到有DNP字样,4脚和38脚那两个电阻您是没有焊接吗?这两个管脚是需要接10uF电容的:

    40脚和41脚滤波器需要接上;

    图中的4个电感我依照型号使用了1000ohm的贴片电感;

    是使用的与EVM一样型号的BLM15HD102SN1D吗?

    此时外部电源供电电流达500mA,CDCE62005发热严重,且实际电压只有3.17V,这种压降是为什么?电流过大又是为什么?(经测量电容没有损坏)

    您是什么输出?LVDS输出,供电电流至少500mA,LVPECL输出和LVCMOS输出需要的供电电流更多,若电源提供不了这么多电流,那么供电电压降被拉低。

    您测试几块板子发热严重,多测试几块板子呢以排除焊接问题

  • 感谢您的回复,我已按照您的建议重新焊接(如30脚、40脚和41脚)

    上电时,我的外部台式电源供电为3.3V,电流没有超出限制因此不会降低输出电压。但在板子上实测,输入电源电压只有3.17V,请问这可能是什么原因导致的呢?(我在这方面的经验不足)

    另外经过我的测量,电感【L13】两端电压分别为3.09V和1.7V,为什么会出现这样的压降呢?其他电感两端没有这种情况出现。

    非常希望您能为我解惑,谢谢!

  • 另外还想请教一下,EVM电源的这一部分的作用是什么呢?会不会是没有设置这个部分影响了我的电路?

  • 上电时,我的外部台式电源供电为3.3V,电流没有超出限制因此不会降低输出电压。

    您的意思是您使用的台式3.3V电源可以提供足够的电流是吗?

    电感【L13】两端电压分别为3.09V和1.7V,为什么会出现这样的压降呢?其他电感两端没有这种情况出现。

    电感电流变化会在电感上产生感应电势,电感两端电压压差大说明流过电感的电流变化快或变化幅值大,您是否将VCC_VCO的滤波电容放置在CDCE管脚附近?

    PCB  layout 是否放置了足够多的过孔?

    下面是 CDCE62005 EVM Gerber 文件,您可以参考下PCB LAYOUT:

    slp-310-0023-02_odb++.tar

  • 另外还想请教一下,EVM电源的这一部分的作用是什么呢?会不会是没有设置这个部分影响了我的电路?

    这部分电路有些错乱,看网络标号是连接到 TUSB3210的管脚,TUSB3210这个芯片停产了,我在TI官网找不到其相关资料了。但仅关于CDCE的应用应该与这部分没有关系。