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你的时钟是多少?信号频率,幅度(dBm)?spur的频率和幅度?这个spur是固定的么?开没开SNRBoost?
会不会是输入源不干净?可以考虑把信号源直接接到频谱仪上,看看频谱仪的结果。如果信号源本身就有spur,那就不是58c28的事了。
你的应用是什么?RRU?repeater?要是开了SNRBoost,spur又落在“坑”外,有没有可能在DSP里滤?另外原帖里“就在该节点探测“怎么理解?是指信号源与ADC连到一起后,信号源的频谱上冒出了一根spur?
你的信号的功率是多大的,有没有加带通滤波器?从现象上看应该是信号的谐波。你的信号源是用什么产生的
ADC时钟200M,频率150MHZ,输入信号的功率很小,ADC并没饱和,没有打开SNRboost,信号源是用安捷伦的信号源,信号源是纯净的。应用在RRU上。
把信号源与ADC的输入端连一起,输入150M的信号,把ADC的时钟断开,不让ADC工作,在ADC与信号源的连接点探测,信号频谱没杂散,但是把ADC时钟连上,让ADC工作,在ADC于信号源的连接点探测,就有杂散。
这个有没有可能是时钟的谐波引起的杂散呢,会不会ADC时钟过高。谢谢
ADC时钟200M,频率150MHZ,输入信号的功率很小,ADC并没饱和,没有打开SNRboost,信号源是用安捷伦的信号源,信号源是纯净的。应用在RRU上。
把信号源与ADC的输入端连一起,输入150M的信号,把ADC的时钟断开,不让ADC工作,在ADC与信号源的连接点探测,信号频谱没杂散,但是把ADC时钟连上,让ADC工作,在ADC于信号源的连接点探测,就有杂散。
这个有没有可能是时钟的谐波引起的杂散呢,会不会ADC时钟过高。谢谢
另外信号是单端还是差分?如果是单端,时候考虑了阻抗匹配问题?附上ADS58C28的EVM电路图,供你参考。
如果是时钟谐波引起的,那杂散的位置应该在m*Fsig+n*Fclk或者m*Fsig-n*Fclk上,类似于一个混频的过程。你的时钟是从哪里来的?如果认为是时钟的问题,可以测一下时钟信号的频谱。
时钟是从时钟芯片CDCE62005产生的,测时钟信号频谱是有杂散的,但是如果是时钟信号杂散,那也应该不会对输入ADC的信号产生杂散的吧,这个杂散感觉有点像是反射回来的信号
可能网速不好,添加不了附件
有邮箱吗,给您发邮件吧
附件是ADC输入的信号频率,分别是140MHZ,150MHZ,160MHZ,输入功率均为-50dbm,ADC采样时钟是199.68,附件中的图是ADC采样后数据画的频谱。多谢
PCB布线时没有把时钟和数据线做等长处理,时钟11mm,数据线从11mm到22mm长度不等,我在FPGA内部并没有对数据做延时,会不会与这个原因有关,但即使与这有关,应该是ADC采样后数据不对,但应该不会在ADC输入端口能检测到杂散吧,把ADC时钟断开,在ADC输入加纯净的单音信号,就在该点测试无杂散,但是把ADC时钟连上,同样给ADC输入加纯净的单音信号,就能测大杂散,测试时钟是有杂散的,会不会与这个时钟杂散有关。非常感谢
两个问题,需要你进一步解释一下。
1. fft一般是0~fs/2,在你的应用里,应该是从0到100MHz,为什么三幅图有两副从-50MHz到50MHz?还有一副干脆从-10MHz到90MHz?须知-10MHz~0的频谱和0~10MHz是对称的,你把90MHz~100MHz的频谱丢了。
2. 为什么140MHz.BMP这个文件里的峰值落在40Mhz?200MHz采140MHz应该落在60MHz吧?
从140MHz.BMP和160MHz.BMP这两幅图还看出来一个信息:直流附近不干净,直流有一根峰,两边5MHz的地方各有一根峰。以140MHz.BMP这种情况来看,5MHz的spur又把信号调制到35MHz/45MHz。你看一下62005的输出时钟在距离信号+/-5MHz频偏的地方有没有spur?如果有,想办法把这两根spur调下去。62005的内部loop filter应该能满足5MHz频偏下无spur。
我是从射频加的信号,中频频率在149.76mhz,采样率199.68Mhz
我画的也包含负频率部分
这个图是截的图,有一副图频率在60M附近,看不到,就拉过来截的
-50MHz~0的频谱和0~50MHz的频谱是对称的,你只提供-50~50MHz的频谱,我看不到50MHz~100MHz的信息。所以还是把0~100MHz的fft发过来,方便评估。
附件已经添加到原帖。看上去有两种spur,一种是很可疑的5MHz,还有一个是信号的二次谐波。以140MHz为例,时钟(或其他地方)有5MHz的成分,和输入信号做类似混频的动作,从而在55MHz有spur;还有一个应该是200MHz采信号的二次谐波280MHz,落到80MHz一根spur。建议检查62005输出时钟,看看在5MHz频偏下有没有spur。
测试时钟的质量,时钟存在杂散,偏离ADC时钟3M有个杂散,与时钟的幅度差是60db,偏离12.5M有个杂散,幅度差大约60db,偏离18.5M有个杂散,幅度差大约59db,偏离时钟左变74.5M有个杂散较大,与时钟幅度差为45db
1. 从你提供的信息来看,时钟性能很差,建议先优化62005,排除时钟的问题后,再测ADC。
2. 先前有给过你58C28的EVM电路图,你先看一下,应该有参考价值。另外可以看一下58C28的User Guide,会有帮助。
最好能附上一张62005测杂散情况的图,看一下杂散的频率和功率。不过我之前也测过62005,这颗芯片杂散抑制不可能这么差啊,基本上1MHz以外应该是可以抑制到70dB以上的。你要是有EVM和GUI,把GUI里的配置发过来一份。
另外,这些spur会不会是你的晶振不干净,漏过来的?62005的输出buffer可以选择输入源的,你把射频信号发生器(质量好一点的)接到62005的PRI或者SEC上,然后输出buffer就选择这个PRI或者SEC,也就是把62005里面的PLL bypass掉,从信号发生器来的时钟直接进频谱仪和ADC,看看效果如何?PRI在LVCMOS下能cover到250MHz,LVDS下能cover到800MHz,应该够200MHz的应用。
另外,你的62005开了几个输出通道?测试的时候只开一个,其他的通道和输出分频器全部power down。
射频信号源或者晶振进62005,直接buffer输出,不过PLL,看看输出端的情况。做这个测试的时候把其他所有通道和通道的分频器power down。另外,你输入到62005的参考频率是多少?