TI生产的pipeline型的ADC常常利用采样过程中的混叠现象,用较低的采样率来把中频处的信号搬移到基带在进行处理,这样可以降低对高速ADC的速度要求,这时在采样前需要对模拟信号进行带通滤波,保证搬移到基带不会被Fs/2内的信号干扰,因此,Pipeline型的ADC也常常被称为欠采样ADC。(原文 德州仪器高性能单片机和模拟器件在高校中的应用和选型指南 p13),请问这里所说的把中频处的信号搬移到基带进行处理,是怎么实现的?不理解?请教
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TI生产的pipeline型的ADC常常利用采样过程中的混叠现象,用较低的采样率来把中频处的信号搬移到基带在进行处理,这样可以降低对高速ADC的速度要求,这时在采样前需要对模拟信号进行带通滤波,保证搬移到基带不会被Fs/2内的信号干扰,因此,Pipeline型的ADC也常常被称为欠采样ADC。(原文 德州仪器高性能单片机和模拟器件在高校中的应用和选型指南 p13),请问这里所说的把中频处的信号搬移到基带进行处理,是怎么实现的?不理解?请教
但是从这个时域中看,我还有一下迷惑,第一,是不是我可以每隔任意周期采一个点,这样的话,那么任意高的频率好像都可以采集,只要我隔的周期多就可以了,第二,用一个例子来说明香农定理,对一个具有150MHz最大信号频率,但只有10MHz 带宽的信号进行采样,可能只需要一个约22MSPS的ADC,而不是Nyquist规定的大于300MSPS的 ADC,在这里的欠采样好像没体现,香农定理所说的带宽,第三,按这么说任意AD均可以利用编程来欠采样,为什么书上只说pipeline型AD呢,何意请教楼主
楼主看附件,能够解释你所有的问题。如有不懂再问。
pipeline结构是目前市场上采样率和精度综合最高的,用于高速信号采集的应用。从应用角度,SAR型采样率不够的时候,就没有必要欠采样了,直接用pipeline即可。另外,还有一点比较重要,就是采样保持电路的带宽要能够满足过采样信号的要求。
欠采样对应的是带通采样。按照数学定理,时域的采样等于频域的周期延拓。因此你在时域采样时,会自动有等幅的信号给延拓到-Fs/2到Fs/2之间的。类是于一个理想的下变频。