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THS1209 - SYNC输出与TestMode

Yixin Ma
Prodigy 21 points


1、在TestMode下，为什么有SYNC输出？而且输出频率与CONV_CLK频率不相关。CONV_CLK为100kHZ，SYNC输出为3MHz或者6.8MHz左右，不固定。即使CONV_CLK信号停止了，仍然有SYNC输出。

2、读数据的过程中，/RD信号为由CONV_CLK经过延时产生。/RD低电平的半周期内，数据线上的数据不是稳定的，而是有几次方波样的跳变。

3、在TestMode下，Control Register0的bit7-3的设定是否可以为任意值？

盼回复！