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可编程延迟和相位控制中，在DLYCTR引脚的第32个上升沿上，在接下来的一次或者两次DLYCTR引脚的上升沿中，不会更新相位。能否解答一下到底是一次还是两次？
Hi,
DATA sheet 中描述：For every 32 edges, there are one or two edges for which the phase aligner does not update the phase.
它可并没有说是one or two rising edge哦？！ 明白了吧，就是说会有下降沿，当然那个是“附带的”。
您好，在DATA sheet中Table 3. Programmable Delay and Phase Alignment第一列的确说的是每一个DLYCTR的上升沿。另外，还有一个问题，DLYCTRL引脚的频率一定要小于或者等于LEADLAG引脚的频率吗？LEADLAG引脚只是控制信号，频率很低然而DLYCTRL引脚可以很高啊
