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[参考译文] LOG300:脉宽失真度

Guru**** 2513185 points
Other Parts Discussed in Thread: LOG300

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/amplifiers-group/amplifiers/f/amplifiers-forum/1560379/log300-pulse-width-distortion

部件号:LOG300


工具/软件:

你(们)好

我有一个原型使用 LOG300DR、后跟一个位于缓冲器输出端的数据切片器、用于接收 OOK(开关键控)信号。 要进行测试、I GATE 的是占空比为 50%的较低频率方波的 337.5kHz 载波、因此模拟了一个 1010 重复的字符串。 我发现、LOG300 对数放大器级会对载波的启动做出快速反应、但不会在载波关闭时做出反应。 其影响是 高电平脉冲的持续时间(对应于载波存在)增加了约 15 μ s、同时低电平脉冲持续时间也相应减少。 此外、LOG300 输出信号的下降沿具有“噪声“/包含纹波、从而导致高电平脉冲持续时间发生变化。

这是在 LNA 和对数放大器之间没有滤波器的情况下发生的。 对数放大器输入在两种情况下都与相同的元件匹配、包括 Log_Inm 引脚上的 1kΩ。

3.3V 电源、R_F = 30kΩ、C_OFFSET = 18nF、REF_RES = 56kΩ

将 C_F 从我设计的 270pF 更改为 100pF 没有太大区别(除了增加信号中的噪声)。

到目前为止、唯一的解决方案是将数据比特率降低到 15us 无关紧要的程度、但从系统的角度来看、这是不可取的。

考虑到载波存在时输出变为高电平、我想知道对数放大器输出或缓冲器是否会进入饱和状态。 这可能意味着饱和恢复是此处发挥作用的机制。

您有任何建议吗?

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    在高电平到低电平转换期间、 下降时间由 LOG_OUT 引脚上的 CF 和 RF 决定。 您的主板中 CF 和 RF 的值是多少?

    是否可以尝试使用 1M Ω 探头直接探测 LOG_OUT 引脚? 这将可以指示运算放大器饱和是否是一个问题。 Log_Out 引脚是 本机检测器输出。

    我还看到、由于 BPF 或输入信号链中的任何其他电容器、输入信号缓慢衰减也会减慢 LOG300 输出的速度。 是否可以直接将简单的电容耦合输入应用到对数检测器块输入,而无需任何 BPF(绕过 LNA 并直接提供给对数 300 输入)。

    1) 最重要的是下降时间是 CF 和 Rf ,是下降时间与 CF 和 Rf 匹配的时间常数。

    2) 任何波形,你可以在这里发帖

    3) 你实现的上升时间是多少

    4) 什么是您可以接受的理想上升和下降时间   

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    我还得到了一个注意从设计师,你可以尝试削减偏移消除电容 1/4 . 他认为可以使偏移消除环路更快、从而使 LOG300 的响应速度更快。

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    我在引脚 12(SOIC 封装)上通过 100nF 馈送信号(黄色迹线)。 引脚 11 具有 100nF 接地。 然后在引脚 5 和 10(蓝色迹线)上测量 I。

    我使用了两个信号电平进行比较:10mVpp 和 100mVpp。 随着信号的增大、引脚 10 上的高电平饱和、然后在下降沿出现延迟。 这证明了缓冲器中的饱和恢复理论。  在上升时间似乎减小的情况下也可以看到这一点。

    感谢您的建议,我将继续学习和改进我的电路 — 可能还有其他因素。

    引脚 5 @ 10mVpp

    引脚 10 @ 10mVpp

    引脚 5 @ 100mVpp

    引脚 10 @ 100mVpp

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    了解您的观点。

    我还想指出,最后一张图显示它受偏移抵消环路带宽的限制。  我们可以建议使用 2nF 失调电容并再次检查瞬态时间。 您也可以检查缓冲区输出是否有大容量。 您还能检查缓冲器反相输出吗? 您将看到反相输出,但我们可以检查是否确实看到过驱恢复行为。