上电电路输出具有6.5ms 过冲、不知道是什么原因? 请帮助我进行分析。
电源:24 v-DCDC-5 v-LDO-3.3V
5V 基准芯片3V-1.5V VREF
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上电电路输出具有6.5ms 过冲、不知道是什么原因? 请帮助我进行分析。
电源24V -DCDC-5V 5V-LDO-3.3V
电源:24 v-DCDC-5 v-LDO-3.3V
5V 基准芯片3V -1.5V 基准电压
5V 基准芯片3V-1.5V VREF
您好、Carl、
在上电后、让 OPAMP 有一段时间保持稳定。 因此、在上电后、一个位过冲是完全正常的。
如果过冲持续时间更长、则可能是电路中由 Rs 和 Cs 形成的时间常数。 遗憾的是、我在您的原理图中看不到任何组件值。 因此,我不可能给出更具体的答案:-(
C14和 C20很危险。 它们会侵蚀相位裕度、并可能导致不稳定。
您能否发布完整的原理图? 更多细节,更多帮助:-)
Kai
您好、Carl、
120k 和100nF 低通滤波器形成12ms 的时间常数。 因此、我认为过冲只能通过减小该时间常数来降低。
不幸的是、还有另一个问题。 您的电路不稳定。 相位裕度仅为26°:
e2e.ti.com/.../carl_5F00_opa4348.TSC
Kai
大家好、Carl、
我要取下1n 电容器(C20)并添加这个缓冲器:-)
e2e.ti.com/.../carl_5F00_opa4348_5F00_1.TSC
Kai
您好、Carl、
我还应该提到的一点是:一旦您决定电路、最好独立检查两级的稳定性、以确保两级都是稳定的。
第一阶段将需要一个更复杂的程序、如下面的 Kai 所示。 您可以复制他的电路或从 Tim Green 的演示文稿"DualFB Beta_plus and Beta_minus RevD.pptx"中了解有关该方法的更多信息。 第二级更简单、可以使用 TI 高精度运算放大器稳定性实验室中所示的方法来完成。
如果您对此有任何疑问、请告诉我。
此致、
Daniel