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[参考译文] TM4C123GH6PGE:器件保持复位时的引脚状态

Guru**** 2454020 points
Other Parts Discussed in Thread: SEGGER

请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/microcontrollers/arm-based-microcontrollers-group/arm-based-microcontrollers/f/arm-based-microcontrollers-forum/637823/tm4c123gh6pge-pin-states-while-device-held-in-reset

器件型号:TM4C123GH6PGE
主题中讨论的其他器件:SEGGER

您好!

我在数据表中找不到这方面的答案-如果器件保持复位(RST lo)、器件 I/O 引脚是否全部为三态?

我提出的原因是、在生产中、我希望工厂在将串行闪存芯片焊接到电路板并连接到 Tiva 的情况下使用 JTAG 对其进行编程。

谢谢

Richard

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    当 RST 有效(RST 为低电平)时、这些引脚为高阻抗。 但是、如果使用 SSI0、请注意、如果 ROM 引导加载程序代码运行、则在释放复位后立即将该模块简要配置为从器件。
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    [引用用户="Richard alind"] 希望工厂在将串行闪存芯片焊接到电路板并连接到 Tiva (置入复位状态)时使用 JTAG 对其进行编程。[/quot]

    我不确定、"在"复位"期间依赖 MCU 的行为-可能只是"在之前"或"在退出时"-证明是最佳的。   (我们的客户有时会遇到这种做法的问题。)

    是否不会证明它"更安全"且更受控制- MCU 执行(非常小的程序)、强制您的指定引脚进入所需状态、并通过独特的 GPIO 切换进行"宣布"、从而针对(任何/全部)潜在的"瞬态条件"提供强大/可靠的"保护频带?   只有在接收到该唯一 GPIO 切换时-串行闪存的编程才会开始。

    按照这一(公认的)更严格的程序、在对串行闪存器件进行编程之前、可以确保"潜在干扰"大大降低-并确认(部分) MCU 响应水平...

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    您好 Richard、
    还有一个想法。 JTAG 接口只在加电时复位。 保持 RST 为低电平不会复位 JTAG 引脚。 TDO 在"测试逻辑复位"状态下将为高阻抗、但在扫描时将变为输出。 TM4C 的 JTAG 和串行闪存是并行还是串联的?
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    您也可以使用 Segger 的方法并使用 JTAG 接口对外部闪存进行编程。

    为什么使用多个程序员会使您的生活变得更加困难?

    Robert
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    啊——现在又回复了:)非常感谢你们的回复和支持。

    实际上、我有一个具有串行闪存的 Tiva、该闪存为也连接到 Tiva 的 FPGA 保存图像。 Tiva 使用闪存中的映像来引导 FPGA。 这是我在许多设计中成功使用的设置。

    通常、我会使用 Tiva 中的 ROM 引导加载程序(通过 UART 或 USB/DFU)和我们自己的自定义软件对原电路板进行编程并进行现场升级。 闪存可通过 Tiva 进行编程/升级、同样也可使用定制软件进行编程/升级。

    该特定工程是对现有产品的反向调整(因为器件已停产)、无法使用引导加载程序、因此我尝试为工厂提供一种简单的方法、以便将初始映像放入 Tiva 和闪存中。 Tiva 代码必须包含一个定制引导加载程序、该引导加载程序可以通过传统连接(通过 FPGA)运行。 因此、我希望知道如何从一个 JTAG 连接器对两个器件进行编程。 这是罗伯特的意思吗?

    Richard
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    是的、看看 Segger、他们针对许多外部器件执行此操作。 我希望他们所做的与对内部闪存进行编程以及将存根下载到执行编程的 RAM 中一样。 我没有使用过它、因此我不知道它的配置有多容易、但支持在那里并在扩展。

    Robert
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    是否可以指出,"无解决办法"的任命比"获奖者"更具吸引力(肯定更详细)?
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    CB1 -很抱歉、我不明白您的情况!