[参考译文] TMS570LC4357：需要有关 GPIO[A|B] DMAREQ 时序的说明。

您好 Ulf、

您的想法是有效的。 该请求在 HCLK 上升沿被锁存、并且应该在至少1个 HCLK 周期内保持高电平。

整个块已传输、但尚未完成、因此该通道的 DMA 状态位仍然置位。 新请求将处于挂起状态、该通道的挂起寄存器中的位将被置位。

这又是模棱两可的。

我想将 DMAREQ 置为有效、并在访问 FPGA 之前使 DMAREQ 保持有效。

 访问 FPGA 时、应将 DMAREQ 信号置为无效。

DMA 控制器只应传输一个帧。

如果挂起寄存器由于这个原因被置位、那么我相信这将导致两个帧的传输。

如果 DMAREQ 在两个时钟周期内有效、这是否意味着将发生两次传输？

如果 DMA 通道已经完成了块的所有帧的传输、并且接受了 BTC 中断、我还需要对会发生什么情况进行回复、

但下一个 DMAREQ 在 DMA 通道重新初始化之前出现。

有任何有关这方面的新闻吗？

您好、Ulf、

我想将 DMAREQ 置为有效、并在访问 FPGA 之前使 DMAREQ 保持有效。
QJW>没关系。 DMAREQ 可以尽可能保持激活状态。

访问 FPGA 时、应将 DMAREQ 信号置为无效。

DMA 控制器只应传输一个帧。
QJW>是的，它应该只传输1个帧用于1个 DMAREQ

如果挂起寄存器由于这个原因被置位、那么我相信这将导致两个帧的传输。
QJW>当一个硬件请求被生成并且通道被启用时、相应的位"通道挂起寄存器(PEND)"被置位。 PEND 位在帧结束时清零。 这不会导致两个帧的传输。

如果 DMAREQ 在两个时钟周期内有效、这是否意味着将发生两次传输？
QJW>否，因为它被触发一次(如果极性为高电平则为上升沿)。

如果 DMA 通道已经完成了块的所有帧的传输、并且接受了 BTC 中断、我还需要对会发生什么情况进行回复、
但下一个 DMAREQ 在 DMA 通道重新初始化之前出现。
QJW>最后一次传输完成后。 新的 DMAREQ 将设置 PEND 位。 但是、当控制数据包被修改时、PEND 位将被清零。

如果我的答案不清楚、请告诉我。 谢谢

好的：这是我解释功能的方式。
当 CPU H/W DMAREQ 被激活时、挂起位被置位、并且如果一个 DMA 被启用、DMA 传输开始
DMAREQ 信号可以是有效的、而不会导致第二个帧被发送、直到在帧结束时挂起位被清零。

如果在挂起位清零前 DMAREQ 信号已经被停用、DMA 开始等待下一个 DMAREQ
如果在挂起位清零前 DMAREQ 信号没有被置为无效、那么新的传输就会开始。

*您能确认这是它的工作方式吗？
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*这就是我怀疑 DMA 工作的方式：您能否确认每个项目。

*已排队的 DMA 传输？
一旦 DMAREQ 被激活并且传输开始：
如果 DMAREQ 在当前传输的挂起位清零前被置为无效、
但在挂起位被清除之前被再次激活、将会出现一个新的请求

*暂挂寄存器清除？
在 DMA 从源读取帧的最后一个字后、挂起寄存器被清除。
这以及之前的几个字可能位于 DMA FIFO 中、正在等待此时写入。

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我的应用程序将从源到两个缓冲区中的 DMA、每个缓冲区包含一个块。
为了避免开销、我的计划是使用两个 DMA 通道、每个通道处理一个缓冲区。
它们将共享相同的 DMAREQ 信号、但一次只有一个有效。
计划使用块传输完成中断在 DMA 通道之间切换。

假设通道#1用于块1、通道#2用于块2。

DMA 通道1。块传输完成中断
启用 DMA #2

DMA 通道2.块传输完成中断：
启用 DMA #1

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在初始化时、我将把控制数据包写入两个 DMA 通道。
这两个信号都将被初始化以使用相同的 DMAREQ 信号
然后、我将启用 DMA 通道#1、但不启用 DMA 通道#2。

*当 DMAREQ 被激活时、即使它未被启用、DMA #2挂起位是否会被置位？

我知道、如果启用了 DMA 通道、并且激活了 DMAREQ、则将设置挂起位
并保持置位、即使我禁用 DMA 通道也是如此。

当通道处于非活动状态时、如果 DMAREQ 上的 DMA #挂起位没有置位：

*如果 DMAREQ 处于活动状态且启用了 DMA 通道、会发生什么情况？
这将设置挂起位并执行传输吗？

请注意 TI 文档中不可能找到的内容：
当外部 DMAREQ 信号在相应的 HWCHENA*位之前有效时，DMA 控制器静默忽略此请求。
请参阅 e2e.ti.com/.../467894

您好、Jiri、

*已排队的 DMA 传输？
一旦 DMAREQ 被激活并且传输开始：
如果 DMAREQ 在当前传输的挂起位清零前被置为无效、
但在挂起位被清除之前被再次激活、将会出现一个新的请求

QJW> DMA 具有一个用于捕获硬件请求的两级缓冲器和一个用于捕获软件请求的一级缓冲器。 如果 DMA 没有完全处理待处理的请求、并且某个外设在同一通道上生成了硬件请求、则 DMA 将捕获此硬件请求并将其识别到其请求缓冲区(二级缓冲区)中。 如果第一个软件请求仍处于待处理状态、DMA 无法识别同一通道上的两个软件请求。 因此软件请求将被忽略。

*暂挂寄存器清除？
在 DMA 从源读取帧的最后一个字后、挂起寄存器被清除。
这以及之前的几个字可能位于 DMA FIFO 中、正在等待此时写入。

QJW>传输结束时挂起位被清零。 一个完整的传输意味着与一个通道相关的所有元件被完全从其源传输到其目的。

您好！

如果 HWCHENAS 内部的通道未启用、并且映射到该通道的硬件请求被置为有效、则硬件请求仍将被置为有效
在通道挂起寄存器(PEND)内捕获。