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[参考译文] RTOS/TM4C1294KCPDT:如何使用 FIFO 启用单字节 UART 中断

Guru**** 2042920 points
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/microcontrollers/arm-based-microcontrollers-group/arm-based-microcontrollers/f/arm-based-microcontrollers-forum/684574/rtos-tm4c1294kcpdt-how-to-enable-single-byte-uart-interrupt-with-fifo

器件型号:TM4C1294KCPDT

工具/软件:TI-RTOS

在启用 FIFO 的情况下、是否可以通过任何方式将接收到的单个字节的中断接收到 UART 中?

FIFO 为16字节深。 接收中断在 μ ⅛、μ ¼、μ ½、和 μ ¾ ⅞ FIFO 满时触发。 最小值1/8 (UART_FIFO_RX1_8)将为2字节。

我的器件在 UART 数据包中接收奇数字节。 我希望在一个字节的传输时间内有一个单个字节的中断、而无需读取该字节。

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    使用其中一个 FIFO 中断和"接收超时"中断。 这样、如果单个字符在32 (或64)个位周期内没有后面的字符进入、则会得到一个中断。

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    Bob、这是一种巧妙的权变措施。 波特率为19、200、因此这将在1.7 ms 后为我提供 HWI。

    现在、我想我将在没有 FIFO 的情况下到期。 感谢您的建议。
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    免责声明: 我们尚未实施此方法-但代价是"一个 GPIO 和一个分离定时器"-这是一种更快的方法(快2倍!) 可替换为。   (再次-在"理论"中)

    此(未确认)方法如下:

    • 将您的信号绑带到(两者都是)"UART_RX"和(理想情况下)附近的(备用) GPIO。
    • 将 GPIO 编程为"在一个"下降沿"上的中断-但仅在(比如说) 2个 UART 字节时间之后、信号在"逻辑高电平"时经过。
    • 将(添加的)拆分定时器编程为 "超过一个字节时间"(即一个字节时间的持续时间)+ 10-20%(出于安全考虑)的值
    • 此计时器到期时-读取 GPIO。   如果 GPIO 为"高电平"-它看起来、 "可以假设、"只有一个字节"已到达
    • 此时(缩短)-您可以"读取 UART 的单字节"。

    如果这起作用-如果这起作用-它是由于:

    • 检测负驱动"起始位"
    • 后跟"Timely Detection of the Stop bit"
    • 和持续(超出停止位10%)"逻辑高电平"
    • " 背靠背" UART 字符到达的可能性(或至少已知/可预测)为"字符间延迟!"  

    以上内容表明(实际上)-(仅)已到达单字节。   以及输入小于16个 UART 位时钟的"警报"。。   (再次-可以"调整"以最好地适应" 字符间延迟!")   请注意、这些(相同)字符间延迟将"同样地"影响(较早/较慢) rmethod -但可以通过 这种(独特且资源丰富)方法"考虑"和"克服"...

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    好主意 CB1。 这样的 PCB 编辑会将中断前的时间缩短一半以上。

    您为一份海报提出了类似的想法、该海报旨在检测半双工系统中的总线活动。
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    谢谢 Peter -谢谢。

    一个"好/新颖的想法"-如果(真正)符合该规范。 应该"可以重复使用-任何地方和任何地方"、以最大限度地提高"创意投资回报"。

    有时、对设备的"精细细节"了解较少、会强制采用不同的"问题解决"方法、有时、客户会对这些方法非常重视...