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器件型号：TMS570LS3137 您好！
在技术参考手册(SPNU499C)第2.5.1.44节中、可以找到以下注释：
注意：VCLK 和 VCLK2时钟比率限制。 VCLK2频率必须始终大于或等于 VCLK 频率。 VCLK2频率必须是 VCLK 频率的整数倍。 此外、不得同时更改 VCLK 和 VCLK2时钟比率。 当增加频率(减小分频器)时、首先更改 VCLK2R 域、然后更改 VCLKR 域。 当降低频率(增加分频器)时、首先更改 VCLKR 域、然后更改 VCLK2R 域。 您应该在两次写入之间执行回读。 这可确保两次写入之间有足够的时钟周期。
问题： 违反 VCLK 和 VCLK2时钟比率限制的潜在影响是什么？
谢谢
