主题中讨论的其他器件: SysConfig
当我们的客户在 DDR4初始化阶段使用分析器检查 MODE 寄存器设置时、"模式寄存器6 (MR6)"中的值 A12:A10显示为011b、但011b 表示 AM2434不支持数据速率。

我们的客户包括并使用了使用 SysConfig 工具中的"DDR 子系统寄存器配置"生成的头文件"board_ddrReginit.h"。 与要编程到头文件中 MR6的数据相对应的寄存器位12:10的值显示为001b。
0x00000493U、// DDRSS_CTL_242_VAL
0x00000493U、// DDRSS_CTL_243_VAL
0x00000493U、// DDRSS_CTL_244_VAL
0x00000493U、// DDRSS_CTL_245_VAL
0x00000493U、// DDRSS_CTL_246_VAL
0x00000493U、// DDRSS_CTL_247_VAL
我知道要在初始化阶段设置 MR6、头文件中的这些值在下面的寄存器中设置、并且这些值会按原样反映、是这样吗?
AM64x/AM243x 技术参考手册(修订版 G)
8.1.5.293 CTLPHY_WAP_CTL_CFG_CTLCFG_DDR16SS_Denali_CTL_242寄存器(第4492页)
8.1.5.294 CTLPHY_Wrap _ CTL_CFG_CTLCFG_DDR16SS_Denali_CTL_243寄存器(第4493页)
8.1.5.295 CTLPHY_WAP_CTL_CFG_CTLCFG_DDR16SS_Denali_CTL_244寄存器(第4494页)
8.1.5.296 CTLPHY_WAP_CTL_CFG_CTLCFG_DDR16SS_Denali_CTL_245寄存器(第4495页)
8.1.5.297 CTLPHY_WAP_CTL_CFG_CTLCFG_DDR16SS_Denali_CTL_246寄存器(第4496页)
8.1.5.298 CTLPHY_WAP_CTL_CFG_CTLCFG_DDR16SS_DENALI_CTL_247寄存器(第4497页)
为什么 MR6被设定为一个与头文件不同的值?
在初始化阶段可以通过训练更改 MR6设置吗?
此致、
大辅

