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[参考译文] OCRM-AM263X:用于锁步的 MCU-PLUS-SDK 分布?

Guru**** 1836150 points
Other Parts Discussed in Thread: AM2634, UNIFLASH, AM263P4
请注意,本文内容源自机器翻译,可能存在语法或其它翻译错误,仅供参考。如需获取准确内容,请参阅链接中的英语原文或自行翻译。

https://e2e.ti.com/support/microcontrollers/arm-based-microcontrollers-group/arm-based-microcontrollers/f/arm-based-microcontrollers-forum/1381316/mcu-plus-sdk-am263x-ocram-distribution-for-lockstep

器件型号:MCU-PLUS-SDK AM263X
主题中讨论的其他器件:UNIFLASHAM263P4、AM2634

工具与软件:

你(们)好

应该如何为锁步情况定义 OCRAM 存储器区域?

从文档中我了解到 TCM 翻倍、如果第二个 CPU 没有映像、QSPI SBL 将自动切换到锁步模式。

在这种情况下、两个处于锁步模式的 CPU 是否具有相同的 OCRAM 区域?

检查了显示锁步错误机制的示例: CCM 、但 OCRAM 不共享、并且 targetconfigs 似乎不完整(在任何位置至少没有设置辅助标志或其他标志、所有四个内核都处于活动状态)。

是否有更好的示例或应用手册显示 CPU 以锁步模式运行时的 RAM 区域?
外部存储器也是一个主题、因为我们可能被迫使用 GPMC。

此致、

Barna cs.

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    您好、Barna、

    当给定集群的 CPU 在锁步模式下运行时、Core0 可以利用 Core1的 TCM 空间、从而提供64KB TCMA 和64KB TCMB。 在双核/拆分模式下、每个内核都可以访问32KB TCMA 和32KB TCMB。 Core0的实际可访问存储器区域仍然在内核本地(相同基地址)、但长度加倍。

    每个集群的 Core0之间仍共享(2MB、1MB 或0.5Mb -取决于 OPN)的 OCSRAM。

    您能否在下面详细说明一下您的评论、 此处提供的理想解决方案是什么?

    [quote userid="5959592" url="~/support/microcontrollers/arm-based-microcontrollers-group/arm-based-microcontrollers/f/arm-based-microcontrollers-forum/1381316/mcu-plus-sdk-am263x-ocram-distribution-for-lockstep 不共享 OCRAM 并且 targetconfigs 似乎不完整(在任何位置至少没有设置辅助标志或其他标志、所有四个内核都处于活动状态)。

    此致、

    Zackary Fleenor

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    你好、Zackary

    可以从文档中清楚地了解 TCM (core0在锁步时同时使用 A 和 B)。

    我感兴趣的是 OCRAM -在锁步模式下、同一集群中的第2个控制器与 Core0共享同一个区域吗?

    示例:

    Core0_0和 Core0_1都将使用相同的 RAM 部分 、从0x70040000开始、长度为 0xC8000?

    我希望最大限度地利用 OCRAM 部分、由于我们以锁步方式运行、因此我希望可以简单地将0x70040000 (SBL 来自 0x70000000)至0x701D0000 (USER_SHARED_MEM 部分)之间的 RAM 部分减半、并为第一个集群(如 prev 映像)和第二个集群分配一半:

    存储器映射如下所示:
    256K SBL (从0x7000000开始)
    ~800K 第一个集群(0x70040000)
    ~800k 第二个集群(0x70108000)
    ~144k 共享信息(共享存储器、记录器、IPC 从0x701D0000开始)  

    您能否在下面详细说明您的评论、 在这里提供什么是理想的解决方案?

    我对 Sitara 的锁步并不熟悉、当时我不确定堆栈和堆是否在同一集群中是通用的、还在搜索任何设置。
    当创建新工程时,默认情况下,所有4个内核上的 targetconfig 都是默认的,即使工程为0_0或0_1 (如空示例),这对新手来说有点令人困惑:)  

    同时设法修改空 项目以使锁步运行-如果我使用 uniflash 将测试项目+sblqspi 映像写入开发板、至少会返回 SOC_rcmIsR5FInLockStepMode 返回1。

    此致、
    巴纳

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    您好、Barna、

    我想跟进有关此用例和预期的其他专家。  根据您的问题、将一半 OCRAM 分配给 cluster1并将一半分配给 cluster2不是问题、它们应该与每个集群的 Core0相关联、Core1还将并行接收/发送数据以 实现两个内核之间的锁步、因此我认为堆栈/堆将处于 每个集群的通用存储器空间中。

    很高兴听到您已在锁步中运行的空项目上取得进展。 期待在收到上述评论后收到进一步的进展和其他问题。

    此致、

    Zackary Fleenor

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    你好、Zackary

    我想与一些其他专家跟进此用例及预期

    我们将有大量代码 -库可能会耗费程序内存(我们需要几个 CAN 库和大量的输出控制)、因此我希望有尽可能大的 OCRAM 来容纳其中的所有内容。 这就是我需要使用我拥有的每个字节的原因。 用例是2个锁步聚类。

    我 当时还在检查 GPMC (通用存储器控制器)、但我没有找到任何关于该存储器如何映射的信息(如果将其映射到存储器空间)。 正如说明和 GPMC_PSRAM_IO 中的代码一样、我宁愿将其视为用于存储/检索数据的读取/写入类型外部存储器、但不打算在其中存储代码。 对吗?

    最后一个选项是我们检查 AM263P4、它具有3G RAM、它可进行引脚组合并且还具有 XPI、但在任何地方都找不到任何库存。 当它将更广泛地提供时、您是否有任何日期、或者它是新的、还没有生产库存的路线图?  

    此致、
    巴纳

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    您好、Barna、

    我知道您需要大量的程序存储器。 GPMC 是一个选项、但不支持任何类型的 XIP 功能、它仅用于存储数据、直到它可以加载到器件并从片上存储器执行。  

    我将邀请另一位专家、介绍 AM263Px 器件的时间表预期。

    此致、

    Zackary Fleenor

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    您好、Barna、

    TI.com 上提供了适用于 AM263P4的器件:

    如果您需要量产级数量/订单、我们无法在 E2E 上为您提供帮助。 您需要联系当地的销售代表或客户支持中心。

    此致、

    Ralph Jacobi

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    你(们)好

    这不是两周前,但很高兴看到它是可用的-第一批可能足够有100或一些东西用于原型设计。 我将在我们的会议上讨论这是否是我们可以交换的东西。

    我对  AM263P4 和 AM2634的可互换性感兴趣 -是否存在可以阻止它的已知问题?

    检查了可移植性、我知道的是 QSPI 与 Optiflash SPI 接口(尚不知道有何差异、我们必须深入了解)、TCM 和 SRAM 将变得更大、XIP 将成为可选方案。

    除此之外、它还具有引脚兼容性、可以切换吗?

    此致、

    巴纳

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    您好、Barna、

    QSPI 和 OSPI 之间肯定会发生需要更改软件的变化。 如果您使用 AM263P4A、这些器件是引脚兼容的 C 封装、其中使用 C 标识符来标识引脚兼容封装。

    以下迁移指南涵盖了有关所有差异的大致详细信息: https://www.ti.com/lit/pdf/spradb3

    此致、

    Ralph Jacobi