工具/软件:
您好:
我们的客户努力达到数据表规格 SNR。 您能为我们提供建议的寄存器设置吗?
它们的配置是 FS 44.1kHz、从模式 MCLK 下的 SE 5Vrms 输入和 SE 外部 Vcom 输出。 可以启用 PLL。
我们需要112dB 的 ADC 和120dB DAC (SE 模式下为-3dB)范围 SNR。
此致、
望月
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您好:
我们的客户努力达到数据表规格 SNR。 您能为我们提供建议的寄存器设置吗?
它们的配置是 FS 44.1kHz、从模式 MCLK 下的 SE 5Vrms 输入和 SE 外部 Vcom 输出。 可以启用 PLL。
我们需要112dB 的 ADC 和120dB DAC (SE 模式下为-3dB)范围 SNR。
此致、
望月
尊敬的 Jeff:
我们的客户获得了 EVM 并运行了 ADC 和 DAC 以及 示例脚本。
他们想验证模拟信号背对背配置、例如5Vrms SE 输入--adc--rs--dac--dac--1Vrms SE 输出(44.1kHz 时)。
为了实现该信号切换、ADC DOUT 应连接到 DAC 的 DIN、SCLK 和 BCLK 也来自 USB 音频 XMOS。
没有用于将 DOUT 连接到 DIN 的跳线引脚、 我们是否应该将这些引脚焊接在 EVM 上?
您是否有此输出的参考脚本?
此致、
望月